- 您現(xiàn)在的位置：買賣IC網(wǎng) > PDF目錄371047 > MC68HC08GR8 (Motorola, Inc.) Low-Cost, High-Performance M68HC08 Family of 8-Bit Microcontroller Units (MCUs)，ROM version of the MC68HC908GR8(低成本、高性能M68HC08系列的8位微控制器(MCUs)：MC68HC908GR8的ROM版本) PDF資料下載
參數(shù)資料
| 型號(hào)： | MC68HC08GR8 |
| 廠商： | Motorola, Inc. |
| 英文描述： | Low-Cost, High-Performance M68HC08 Family of 8-Bit Microcontroller Units (MCUs)，ROM version of the MC68HC908GR8(低成本、高性能M68HC08系列的8位微控制器(MCUs)：MC68HC908GR8的ROM版本) |
| 中文描述： | 低成本，高性能M68HC08系列系列的8位微控制器單元（MCU），光盤版的MC68HC908GR8（低成本，高性能M68HC08系列系列的8位微控制器（MCU）的：MC68HC908GR8的光盤版本） |
| 文件頁數(shù)： | 278/384頁 |
| 文件大小： | 4157K |
| 代理商： | MC68HC08GR8 |
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Serial Peripheral Interface (SPI)
MC68HC908GR8 Rev 1.0
278
Serial Peripheral Interface (SPI)
MOTOROLA
The clock phase (CPHA) control bit selects one of two fundamentally
different transmission formats. The clock phase and polarity should be
identical for the master SPI device and the communicating slave device.
In some cases, the phase and polarity are changed between
transmissions to allow a master device to communicate with peripheral
slaves having different requirements.
NOTE:
Before writing to the CPOL bit or the CPHA bit, disable the SPI by
clearing the SPI enable bit (SPE).
Transmission
Format When
CPHA = 0
Figure 128
shows an SPI transmission in which CPHA is logic 0. The
figure should not be used as a replacement for data sheet parametric
information.
Two waveforms are shown for SPSCK: one for CPOL = 0 and another
for CPOL = 1. The diagram may be interpreted as a master or slave
timing diagram since the serial clock (SPSCK), master in/slave out
(MISO), and master out/slave in (MOSI) pins are directly connected
between the master and the slave. The MISO signal is the output from
the slave, and the MOSI signal is the output from the master. The SS line
is the slave select input to the slave. The slave SPI drives its MISO
output only when its slave select input (SS) is at logic 0, so that only the
selected slave drives to the master. The SS pin of the master is not
shown but is assumed to be inactive. The SS pin of the master must be
high or must be reconfigured as general-purpose I/O not affecting the
SPI. See
Mode Fault Error
. When CPHA = 0, the first SPSCK edge is the
MSB capture strobe. Therefore, the slave must begin driving its data
before the first SPSCK edge, and a falling edge on the SS pin is used to
start the slave data transmission. The slave
’
s SS pin must be toggled
back to high and then low again between each byte transmitted as
shown in
Figure 129
.
8-spi
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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