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參數資料
| 型號： | MC68HC705J |
| 廠商： | Motorola, Inc. |
| 英文描述： | Microcontrollers |
| 中文描述： | 微控制器 |
| 文件頁數： | 82/162頁 |
| 文件大?。?/td> | 683K |
| 代理商： | MC68HC705J |
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Technical Data
MC68HC705J1A
—
Rev. 4.0
82
Low-Power Modes
MOTOROLA
Low-Power Modes
5.4.2 CPU
The STOP instruction:
Clears the interrupt mask (I bit) in the condition code register,
enabling external interrupts
After exiting stop mode, the CPU clock begins running after the
oscillator stabilization delay.
After exit from stop mode by external interrupt, the I bit remains clear.
After exit from stop mode by reset, the I bit is set.
Disables the CPU clock
The WAIT instruction:
Clears the interrupt mask (I bit) in the condition code register,
enabling interrupts
After exit from wait mode by interrupt, the I bit remains clear.
After exit from wait mode by reset, the I bit is set.
Disables the CPU clock
5.4.3 COP Watchdog
The STOP instruction:
Clears the COP watchdog counter
Disables the COP watchdog clock
NOTE:
To prevent the STOP instruction from disabling the COP watchdog,
program the stop-to-wait conversion bit (SWAIT) in the mask option
register to logic 1.
After exit from stop mode by external interrupt, the COP watchdog
counter immediately begins counting from $0000 and continues
counting throughout the oscillator stabilization delay.
NOTE:
Immediately after exiting stop mode by external interrupt, service the
COP to ensure a full COP timeout period.
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