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參數資料
型號: MC74ACT113D
廠商: MOTOROLA INC
元件分類: 通用總線功能
英文描述: DUAL JK NEGATIVE EDGE-TRIGGERED FLIP-FLOP
中文描述: ACT SERIES, DUAL NEGATIVE EDGE TRIGGERED J-K FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO14
封裝: PLASTIC, SOIC-14
文件頁數: 5/6頁
文件大小: 184K
代理商: MC74ACT113D
MC74AC113 MC74ACT113
5-5
FACT DATA
AC CHARACTERISTICS
(For Figures and Waveforms — See Section 3)
Symbol
Parameter
(V)
74ACT
74ACT
Unit
No.
VCC*
TA = +25
°
C
CL = 50 pF
TA = –40
°
C
to +85
°
C
CL = 50 pF
Fig.
Min
Typ
Max
Min
Max
fmax
Maximum Clock
Frequency
5.0
145
125
MHz
3-3
tPLH
Propagation Delay
CPn to Qn or Qn
Propagation Delay
CPn to Qn or Qn
Propagation Delay
SDn to Qn
Propagation Delay
SDn to Qn
5.0
1.0
14.0
1.0
15.5
ns
3-6
tPHL
5.0
1.0
13.5
1.0
15.0
ns
3-6
tPLH
5.0
1.0
11.5
1.0
12.5
ns
3-6
tPHL
5.0
1.0
13.0
1.0
14.0
ns
3-6
* Voltage Range 5.0 V is 5.0 V
±
0.5 V.
AC OPERATING REQUIREMENTS
Symbol
Parameter
(V)
74ACT
74ACT
Unit
No.
VCC*
TA = +25
°
C
CL = 50 pF
TA = –40
°
C
to +85
°
C
CL = 50 pF
Fig.
Typ
Guaranteed Minimum
ts
Set-up Time, HIGH or LOW
Jn or Kn to CPn
Hold Time, HIGH or LOW
Jn or Kn to CPn
Pulse Width
Clock
5.0
2.0
2.5
ns
3-9
th
5.0
2.0
2.0
ns
3-9
tw
5.0
5.0
6.0
ns
3-6
tw
Pulse Width
SDn
Recovery TIme
SDn to CP
5.0
5.5
6.0
ns
3-6
trec
5.0
0
0
ns
3-9
* Voltage Range 5.0 V is 5.0 V
±
0.5 V.
CAPACITANCE
Symbol
Parameter
Value
Typ
Unit
Test Conditions
CIN
Input Capacitance
4.5
pF
VCC = 5.0 V
CPD
Power Dissipation Capacitance
35
pF
VCC = 5.0 V
相關PDF資料
PDF描述
MC74AC113D DUAL JK NEGATIVE EDGE-TRIGGERED FLIP-FLOP
MC74AC113N DUAL JK NEGATIVE EDGE-TRIGGERED FLIP-FLOP
MC74ACT113N DUAL JK NEGATIVE EDGE-TRIGGERED FLIP-FLOP
MC74ACT11D TRIPLE 3-INPUT AND GATE
MC74AC11 TRIPLE 3-INPUT AND GATE
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參數描述
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