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參數資料
型號: MC74ACT377MEL
廠商: ON SEMICONDUCTOR
元件分類: 通用總線功能
英文描述: Octal D Flip-Flop with Clock Enable
中文描述: ACT SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, TRUE OUTPUT, PDSO20
封裝: EIAJ, SOP-20
文件頁數: 4/6頁
文件大小: 199K
代理商: MC74ACT377MEL
MC74AC377 MC74ACT377
5-4
FACT DATA
AC OPERATING REQUIREMENTS
Symbol
Parameter
(V)
74AC
74AC
Unit
No.
VCC*
TA = +25
°
C
CL = 50 pF
TA = –40
°
C
to +85
°
C
CL = 50 pF
Fig.
Typ
Guaranteed Minimum
ts
Setup Time, HIGH or LOW
Dn to CP
Hold Time, HIGH or LOW
Dn to CP
Setup Time, HIGH or LOW
CE to CP
3.3
5.0
5.5
4.0
6.0
4.5
ns
3-9
th
3.3
5.0
0
0
ns
3-9
1.0
1.0
ts
3.3
5.0
6.0
4.0
7.5
4.5
ns
3-9
th
Hold Time, HIGH or LOW
CE to CP
3.3
5.0
0
0
ns
3-9
1.0
1.0
tw
CP Pulse Width
HIGH or LOW
3.3
5.0
5.5
4.0
6.0
4.5
ns
3-6
* Voltage Range 3.3 V is 3.3 V
±
0.3 V.
Voltage Range 5.0 V is 5.0 V
±
0.5 V.
DC CHARACTERISTICS
Symbol
Parameter
(V)
74ACT
74ACT
Unit
Conditions
VCC
TA = +25
°
C
TA =
–40
°
C to +85
°
C
Typ
Guaranteed Limits
VIH
Minimum High Level
Input Voltage
4.5
5.5
1.5
1.5
2.0
2.0
2.0
2.0
V
VOUT = 0.1 V
or VCC – 0.1 V
VIL
Maximum Low Level
Input Voltage
4.5
5.5
1.5
1.5
0.8
0.8
0.8
0.8
V
VOUT = 0.1 V
or VCC – 0.1 V
VOH
Minimum High Level
Output Voltage
4.5
5.5
4.49
5.49
4.4
5.4
4.4
5.4
V
IOUT = –50
μ
A
*VIN = VIL or VIH
IOH
4.5
5.5
3.86
4.86
3.76
4.76
V
–24 mA
–24 mA
VOL
Maximum Low Level
Output Voltage
4.5
5.5
0.001
0.001
0.1
0.1
0.1
0.1
V
IOUT = 50
μ
A
*VIN = VIL or VIH
IOL
4.5
5.5
0.36
0.36
0.44
0.44
V
24 mA
24 mA
IIN
Maximum Input
Leakage Current
5.5
±
0.1
±
1.0
μ
A
VI = VCC, GND
ICCT
Additional Max. ICC/Input
5.5
0.6
1.5
mA
VI = VCC – 2.1 V
IOLD
Minimum Dynamic
Output Current
5.5
75
mA
VOLD = 1.65 V Max
IOHD
5.5
–75
mA
VOHD = 3.85 V Min
ICC
Maximum Quiescent
Supply Current
5.5
8.0
80
μ
A
VIN = VCC or GND
* All outputs loaded; thresholds on input associated with output under test.
Maximum test duration 2.0 ms, one output loaded at a time.
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PDF描述
MC74ACT377N Octal D Flip-Flop with Clock Enable
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MC74ACT377DT Octal D Flip-Flop with Clock Enable
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參數描述
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MC74ACT378 制造商:MOTOROLA 制造商全稱:Motorola, Inc 功能描述:PARALLEL D REGISTER WITH ENABLE
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