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參數(shù)資料
| 型號(hào)： | PCD5096H |
| 廠商： | NXP SEMICONDUCTORS |
| 元件分類(lèi)： | 編解碼器 |
| 英文描述： | Universal codec |
| 中文描述： | A/MU-LAW, PCM CODEC, PQFP44 |
| 封裝： | 10 X 10 MM, 1.75 MM HEIGHT, PLASTIC, SOT-307-2, QFP-44 |
| 文件頁(yè)數(shù)： | 18/52頁(yè) |
| 文件大小： | 222K |
| 代理商： | PCD5096H |
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1997 Jan 22
18
Philips Semiconductors
Preliminary specification
Universal codec
PCD5096
8.3.6
C
ONTROL
R
EGISTER
4 (CR4)
CR4 is used to select the DSP modes. For further information see the “PCD5096 DSP user manual”. Its state after reset
is 0000H.
Table 19
Control Register 4 (address 7CH)
Table 20
Description of CR4 bits
Table 21
Selection of the connection mode for channels LLb and LLa
Table 22
Selection of the operation mode
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
LLb2
LLb1
LLb0
LLa2
LLa1
LLa0
OPM1
OPM0
BIT
SYMBOL
LLb2
LLb1
LLb0
LLa2
LLa1
LLa0
OPM1
OPM0
DESCRIPTION
15 to 8
7
6
5
4
3
2
1
0
These 8 bits are not used.
These 3 bits select the connection mode for channel LLb; see Table 21.
These 3 bits select the connection mode for channel LLa; see Table 21.
These 2 bits select the operation mode, see Table 22.
LLb2
LLb1
LLb0
CONNECTION MODES
LLa2
LLa1
LLa0
0
0
0
0
1
1
1
1
0
0
1
1
0
0
1
1
0
1
0
1
0
1
0
1
Idle mode with reset of LEC coefficients
Idle mode without reset of LEC coefficients
speech and tone
tone generation
dial tone detection
not allowed
not allowed
not allowed
OPM1
OPM0
OPERATION MODE
0
0
1
1
0
1
0
1
connection mode
read/write RAM mode
software reset
not allowed
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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