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參數資料
型號: PCM1851PJTR
英文描述: 24-BIT, 96-kHz STEREO A/D CONVERTER WITH 6 X 2-CHANNEL MUX AND PGA
中文描述: 24位,96千赫立體聲A / D轉換器6 × 2通道的MUX和PGA
文件頁數: 25/30頁
文件大小: 370K
代理商: PCM1851PJTR
PCM1850
PCM1851
SLES108
MARCH 2004
www.ti.com
25
TIMING DIAGRAM
SDA
SCL
t
(BUF)
t
(D-SU)
t
(D-HD)
Start
t
(LOW)
t
(S-HD)
t
(SCL-F)
t
(SCL-R)
t
(HI)
Repeated Start
t
(RS-SU)
t
(RS-HD)
t
(SDA-F)
t
(P-SU)
t
(SDA-R)
Stop
SYMBOL
PARAMETER
MIN
MAX
UNIT
f
(SCL)
t
(BUF)
t
(LOW)
t
(HI)
t
(RS-SU)
t
(S-HD)
t
(RS-HD)
t
(D-SU)
t
(D-HD)
t
(SCL-R)
t
(SCL-F)
t
(SDA-R)
t
(SDA-F)
t
(P-SU)
C
B
V
NH
SCL clock frequency
100
kHz
μ
s
μ
s
μ
s
μ
s
Bus free time between STOP and START condition
4.7
Low period of the SCL clock
4.7
High period of the SCL clock
4
Setup time for START/repeated START condition
4.7
Hold time for START/repeated START condition
4
μ
s
Data setup time
250
ns
Data hold time
0
900
ns
Rise time of SCL signal
20 + 0.1C
B
20 + 0.1C
B
20 + 0.1C
B
20 + 0.1C
B
4
1000
ns
Fall time of SCL signal
1000
ns
Rise time of SDA signal
1000
ns
Fall time of SDA signal
1000
ns
μ
s
pF
Setup time for STOP condition
Capacitive load for SDA and SCL line
400
Noise margin at HIGH level for each connected device (including hysteresis)
0.2 V
DD
V
Figure 32. PCM1851 Control Interface Timing Requirements
相關PDF資料
PDF描述
PCM1850PJT 24-BIT, 96-kHz STEREO A/D CONVERTER WITH 6 X 2-CHANNEL MUX AND PGA
PCM1850PJTR 24-BIT, 96-kHz STEREO A/D CONVERTER WITH 6 X 2-CHANNEL MUX AND PGA
PCM1850 24-BIT, 96-kHz STEREO A/D CONVERTER WITH 6 X 2-CHANNEL MUX AND PGA
PCM1851 24-BIT, 96-kHz STEREO A/D CONVERTER WITH 6 X 2-CHANNEL MUX AND PGA
PCM1851PJT 24-BIT, 96-kHz STEREO A/D CONVERTER WITH 6 X 2-CHANNEL MUX AND PGA
相關代理商/技術參數
參數描述
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