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參數(shù)資料
| 型號： | PI6CV855-02LE |
| 廠商： | Pericom |
| 文件頁數(shù)： | 1/9頁 |
| 文件大小： | 0K |
| 描述： | IC PLL CLOCK DVR SSTL_2 28-TSSOP |
| 產(chǎn)品培訓(xùn)模塊： | Total Timing Technology |
| 標(biāo)準(zhǔn)包裝： | 50 |
| 類型： | PLL 時(shí)鐘驅(qū)動(dòng)器 |
| PLL： | 帶旁路 |
| 輸入： | SSTL-2 |
| 輸出： | SSTL-2 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 1:5 |
| 差分 - 輸入:輸出： | 是/是 |
| 頻率 - 最大： | 200MHz |
| 除法器/乘法器： | 無/無 |
| 電源電壓： | 2.3 V ~ 2.7 V |
| 工作溫度： | 0°C ~ 70°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 28-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 28-TSSOP |
| 包裝： | 管件 |
1
PS8749B
11/13/08
VDDQ
1
2
3
4
5
6
7
8
9
10
11
12
13
14
28
27
26
25
24
23
22
21
20
19
18
17
15
16
Y4
FBIN
VDDQ
GND
Y3
GND
FBIN
FBOUT
VDDQ
Y4
GND
Y0
CLK
Y1
GND
VDDQ
AGND
Y2
Y1
GND
AVDD
Description
ThePI6CV855-02PLLClockBufferisdesignedfor2.5VDDQand2.5V
AVDD operation and differential data input and output levels. The
device is a zero delay buffer that distributes a differential clock input
pair (CLK, CLK) to five differential pairs of clock outputs (Y[0:4],
Y[0:4]) and one differential pair feedback clock outputs (FBOUT,
FBOUT). The clock outputs are controlled by the input clocks (CLK,
CLK),thefeedbackclocks(FBIN,FBIN),andtheAnalogPowerinput
(AVDD). When the AVDD is strapped low, the PLL is turned off and
bypassed for test purposes.
ThePI6CV855-02isabletotrackSpreadSpectrumClockingtoreduce
EMI.
Features
PLL clock distribution optimized for SSTL_2
Distributes one differential clock input pair to five differential
clock output pairs.
Inputs(CLK,CLK)and(FBIN,FBIN): SSTL_2
Outputs (Yx,Yx),(FBOUT,FBOUT): SSTL_2
External feedback pins (FBIN,FBIN) are used to
synchronize the outputs to the input clocks.
Operates at AVDD = 2.5V for core circuit and internal PLL,
and VDDQ = 2.5V for differential output drivers
Packaging (Pb-free & Green available):
-28-pinTSSOP(L28)
Block Diagram
PI6CV855-02
200 MHz SSTL_2 PLL Clock Driver
12345678901234567890123456789012123456789012345678901234567890121234567890123456789012345678901212345678901234567890123456789012123456789012
28-Pin
L
PinConfiguration
Y0
Y1
AVDD
FBIN
CLK
PLL
Y1
Y2
Y3
Y4
Logic
and
Test Ciruit
FBOUT
08-0298
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
| PI6CV855-02LEX | 功能描述:鎖相環(huán) - PLL 170 MHZ 1:10 SSTV Clock Driver RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
| PI6CV855-02LX | 制造商:Pericom Semiconductor Corporation 功能描述:170 MHZ 1:10 SSTV CLOCK DRIVER - Tape and Reel |
| PI6CV855L | 制造商:Pericom Semiconductor Corporation 功能描述:170 MHZ 1:10 SSTV CLOCK DRIVER - Rail/Tube |
| PI6CV855LE | 功能描述:鎖相環(huán) - PLL 170 MHZ 1:10 SSTV Clock Driver RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
| PI6CV855LEX | 功能描述:鎖相環(huán) - PLL 170 MHZ 1:10 SSTV Clock Driver RoHS:否 制造商:Silicon Labs 類型:PLL Clock Multiplier 電路數(shù)量:1 最大輸入頻率:710 MHz 最小輸入頻率:0.002 MHz 輸出頻率范圍:0.002 MHz to 808 MHz 電源電壓-最大:3.63 V 電源電壓-最小:1.71 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:QFN-36 封裝:Tray |
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