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數字音頻的1Introduction1.1FeaturesTAS5508B8通道PWM ProcessorSLES162B的 - 2005年12月 - 2006年REVISED APRIL ?音頻處理一般特點48位處理架構， 76位為大多數音頻ProcessingControl InterfaceFeatures I2C一個易于Useof的精密的自動化操作，控制從串行接口音量控制范圍36 dB到-109 dB的集成的調幅干擾避稅?主音量控制范圍為18 dBCircuitryto -109分貝單， 3.3 V電源?八個獨立通道音量控制64針TQFP PackageRanges 18分貝-109分貝- 5 -V容限輸入可編程軟音量和靜音?音頻輸入/ OutputUpdate價格自動主時鐘速率和四個低音和高音控制WithData采樣率檢測±18分貝范圍，可選擇的角八串行音頻輸入ChannelsFrequencies的，二階道八PWM音頻輸出通道?L ，R和CConfigurable的六通道立體聲? LS ， RSLineout或八通道? LR ， RR線路輸出一個PWM輸出驅動一個? SubExternal的差分輸入操作配置的響度CompensationAmplifier的，兩個耳機PWM輸出的動態范圍壓縮機驅動anTwo閾值，兩個偏移，等ThreeExternal差分放大器每通道PWM輸出支持theSlopesTPA112七二階濾波器單端和全8× 8輸入縱橫混合器。 EachBridge綁LoadsSignal處理通道輸入可以BE - 32 - ， 38 - ， 44.1- ， 48 - ， 88.2 - ， 96 - ， 176.4 ，比8個輸入andAny Channels.192 kHz的采樣率， 8× 2輸出攪拌機，通道1-6 。每個數據格式： 16 - ，20 - ，或24 BitOutput的是一種混合的任何TwoLeft對齊，I2S或右對齊輸入信號處理通道。 IsDataRecommended使用直通-64- FS位時鐘Rateoutput攪拌機Configuration. - 128 ， 192 - ， 256 - ， 384 - ， 512 - 和768- FS -8 × 3輸出混音器，通道7和8 。 EachMaster時鐘速率（最大ofOutput是混合任何Three50兆赫）信號處理通道。 ，它IsRecommended使用通ThroughOutput攪拌機Configuration.三系數設置存儲DeviceCan上可手動或自動選擇（基于特定數據速率） 。 DC阻塞過濾器能夠支持多種的BassManagement算法在數字音頻的DescriptionsTAS5508B8通道2.1.3Terminal PWM ProcessorSLES162B的 - 2005年12月 - 四月修訂2006TERMINAL5 Vtype域（ 1）終止（2） DESCRIPTIONTOLERANTNAMENO.AVDD_PLL9P3.3 - V模擬電源PLL 。這個終端可以連接到用于驅動功率終端DVDD的samepower源，但實現低PLL抖動，這個終端應該繞過一個0.1 μF低ESRcapacitor.AVSS5 ， 6PAnalog groundAVSS_PLL8PAnalog地面PLL AVSS_PLL 。此終端應參照同的地面asterminal DVSS ，但在這個終端必須最小化，以實現低PLL抖動，地面噪聲。 AVSS終端的可用性允許，設計師useoptimizing技術，如星形接地連接，獨立的地平面，或其他安靜地分布技術，實現一個安靜的的地面referenceat這個terminal.BKND_ERR37DIPullupActive低。后端誤差序列產生運用邏輯低thisterminal 。 BKND_ERR結果沒有改變任何系統參數，一切的H橋驅動器信號硬靜音狀態（ M態） 。 DVDD15 ， 36P3.3的-V的數字電源。建議安裝去耦電容of0.1μF和10μF靠近該引腳（見應用原理圖） 。 DVDD_PWM54P3.3 - V數字電源，34， PDigital ground35 /選擇38DVSS_PWM53PDigital地面PWMHP_SEL12DI5 VPullupHeadphone PWMDVSS16 。當一個邏輯低， ：耳機isselected （揚聲器是關閉的） 。當一個邏輯高電平選擇，音箱（耳機） 。 LRCLK26DI5的音頻VSerial數據左/右時鐘（采樣率時鐘） MCLK63DI5 VPulldownMCLK是一個3.3 - V主時鐘輸入。這個時鐘的輸入頻率范圍4 MHz到50 MHz.MUTE14DI5 VPullupSoft靜音輸出，低電平有效（靜音信號=邏輯低，正常運行=邏輯高） 。提供一個無聲的靜音控制音量坡道到silence.Releasing靜音提供了一個無聲的斜坡上volume.OSC_CAP18AOOscillator capacitorPDN13DI5 VPullupPower下來，低電平有效。 PDN權力關閉所有邏輯和停止所有應用clockswhenever邏輯低。內部參數保存througha掉電復位周期，只要不活躍。從掉電為systemrecovery時間為100 ms.PLL_FLT_RET2AOPLL外部濾波器returnPLL_FLTM3AOPLL負輸入。連接到通過一個RC networkPLL_FLTP4AIPLL的正輸入PLL_FLT_RET 。連接PLL_FLT_RET通過一個的RC networkPSVC32OPower供應量控制PWM outputPWM_HPML59DOPWM左聲道耳機（差分 - 差分） PWM_HPMR61DOPWM右聲道耳機（差分 - ） PWM_HPPL60DOPWM左聲道耳機（ + ） PWM_HPPR62DOPWM的右聲道耳機（差分） PWM_M_140DOPWM 1差分輸出（差分 - ） PWM_M_242DOPWM 2個輸出（差分 - ） PWM_M_344DOPWM 3輸出（差分 - ） PWM_M_446DOPWM 4輸出（ - ） （ LINEOUT L）的5 PWM_M_555DOPWM輸出（差分 - ） PWM_M_657DOPWM 6輸出（ LINEOUT R） （差分 - ） PWM_M_749DOPWM 7輸出（差分 - ） PWM_M_851DOPWM 8個輸出（差分 - ） PWM_P_141DOPWM 1輸出（差分+ ） PWM_P_243DOPWM的2個輸出（差分+ ） PWM_P_345DOPWM的3個輸出（差分+ ）
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