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參數(shù)資料
| 型號： | PSD854F2V |
| 廠商： | 意法半導體 |
| 英文描述： | Flash In-System Programmable (ISP) Peripherals for8-bits MCUs, 3V |
| 中文描述： | Flash在系統(tǒng)可編程（ISP）的外設for8位微控制器，采用3V |
| 文件頁數(shù)： | 1/110頁 |
| 文件大小： | 1720K |
| 代理商： | PSD854F2V |
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PRELIMINARY DATA
June 2004
This is preliminary information on a new product now in development or undergoing evaluation. Details are subject to change without notice.
PSD813F2V, PSD833F2V
PSD853F2V, PSD854F2V
Flash In-System Programmable (ISP)
Peripherals for 8-bit MCUs, 3V
FEATURES SUMMARY
FLASH IN-SYSTEM PROGRAMMABLE (ISP)
PERIPHERAL FOR 8-BIT MCUS
DUAL BANK FLASH MEMORIES
–
UP TO 2 Mbit OF PRIMARY FLASH
MEMORY (8 Uniform Sectors, 32K x8)
–
UP TO 256 Kbit SECONDARY FLASH
MEMORY (4 Uniform Sectors)
–
Concurrent operation: READ from one
memory while erasing and writing the
other
UP TO 256 Kbit BATTERY-BACKED SRAM
27 RECONFIGURABLE I/O PORTS
ENHANCED JTAG SERIAL PORT
PLD WITH MACROCELLS
–
Over 3000 Gates of PLD: CPLD and
DPLD
–
CPLD with 16 Output Macrocells (OMCs)
and 24 Input Macrocells (IMCs)
–
DPLD - user defined internal chip select
decoding
27 INDIVIDUALLY CONFIGURABLE I/O
PORT PINS
The can be used for the following functions:
–
MCU I/Os
–
PLD I/Os
–
Latched MCU address output
–
Special function I/Os.
–
16 of the I/O ports may be configured as
open-drain outputs.
IN-SYSTEM PROGRAMMING (ISP) WITH
JTAG
–
Built-in JTAG compliant serial port allows
full-chip In-System Programmability
–
Efficient manufacturing allow easy
product testing and programming
–
Use low cost FlashLINK cable with PC
PAGE REGISTER
–
Internal page register that can be used to
expand the microcontroller address space
by a factor of 256
PROGRAMMABLE POWER MANAGEMENT
■
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Figure 1. Packages
■
HIGH ENDURANCE:
–
100,000 Erase/WRITE Cycles of Flash
Memory
–
1,000 Erase/WRITE Cycles of PLD
–
15 Year Data Retention
3.3V±10% SINGLE SUPPLY VOLTAGE
STANDBY CURRENT AS LOW AS 25μA
■
■
PQFP52 (M)
PLCC52 (J)
TQFP64 (U)
相關PDF資料 |
PDF描述 |
|---|---|
| PSD854F2V-15J1T | Flash In-System Programmable (ISP) Peripherals for8-bits MCUs, 3V |
| PSDPRO | Parallel Port Programmer for ST’s Programmable System Device (PSD) Products(串口編程器，用于ST的PSD產品) |
| PSN0210A | LOW COST - HIGH PERFORMANCE PHASE LOCKED LOOP |
| PSN0800A | LOW COST - HIGH PERFORMANCE PHASE LOCKED LOOP |
| PSN0930A | LOW COST - HIGH PERFORMANCE PHASE LOCKED LOOP |
相關代理商/技術參數(shù) |
參數(shù)描述 |
|---|---|
| PSD854F2V-12JI | 功能描述:CPLD - 復雜可編程邏輯器件 3.0V 2M 120ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| PSD854F2V-12MI | 功能描述:CPLD - 復雜可編程邏輯器件 3.0V 2M 120ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| PSD854F2V-90J | 功能描述:CPLD - 復雜可編程邏輯器件 3.0V 2M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| PSD854F2V-90M | 功能描述:CPLD - 復雜可編程邏輯器件 3.0V 2M 90ns RoHS:否 制造商:Lattice 系列: 存儲類型:EEPROM 大電池數(shù)量:128 最大工作頻率:333 MHz 延遲時間:2.7 ns 可編程輸入/輸出端數(shù)量:64 工作電源電壓:3.3 V 最大工作溫度:+ 90 C 最小工作溫度:0 C 封裝 / 箱體:TQFP-100 |
| PSD-8M-01 | 制造商:Richco 功能描述:CB SPT REST MNT NAT 8MM SPC |
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