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參數資料
| 型號： | PSD913420MIT |
| 廠商： | 意法半導體 |
| 英文描述： | BBG ECL TRNSLATR 9BIT; Package: 28 LEAD PLCC; No of Pins: 28; Container: Rail; Qty per Container: 37 |
| 中文描述： | Flash在系統可編程ISP的外設的8位微控制器 |
| 文件頁數： | 46/110頁 |
| 文件大小： | 1737K |
| 代理商： | PSD913420MIT |
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PSD813F2, PSD833F2, PSD834F2, PSD853F2, PSD854F2
46/110
80C31
Figure
21
shows the bus interface for the 80C31,
which has an 8-bit multiplexed address/data bus.
The lower address byte is multiplexed with the
data bus. The MCU control signals Program Se-
lect Enable (PSEN, CNTL2), Read Strobe (RD,
CNTL1), and Write Strobe (WR, CNTL0) may be
used for accessing the internal memory and I/O
Ports blocks. Address Strobe (ALE/AS, PD0)
latches the address.
Figure 21. Interfacing the PSD with an 80C31
EA/VP
X1
X2
RESET
RESET
INT0
INT1
T0
T1
P1.0
P1.1
P1.2
P1.3
P1.4
P1.5
P1.6
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P0.0
P0.1
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ADIO0
ADIO1
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ADIO5
ADIO6
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ADIO9
ADIO10
ADIO11
ADIO12
ADIO13
ADIO14
ADIO15
CNTL0(WR)
CNTL1(RD)
CNTL2(PSEN)
PD0-ALE
PD1
PD2
RESET
RD
WR
PSEN
ALE/P
TXD
RXD
RESET
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AD0
AD1
AD2
AD3
AD4
AD5
AD6
AD7
AD0
AD1
AD2
AD3
AD4
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6
5
4
3
2
52
51
PSD
80C31
AD7-AD0
AD[7:0]
21
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17
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A8
A9
A10
A11
A12
A13
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RD
WR
PSEN
ALE
11
10
RESET
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12
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AI02880C
相關PDF資料 |
PDF描述 |
|---|---|
| PSD913420MT | 9-Bit Latch/ECL-TTL Translator; Package: 28 LEAD PLCC; No of Pins: 28; Container: Tape and Reel; Qty per Container: 500 |
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| PSD913470JT | Flash In-System Programmable ISP Peripherals For 8-bit MCUs |
| PSD913470MIT | Flash In-System Programmable ISP Peripherals For 8-bit MCUs |
| PSD913470MT | Registered Hex TTL/ECL Translator; Package: 28 LEAD PLCC; No of Pins: 28; Container: Tape and Reel; Qty per Container: 500 |
相關代理商/技術參數 |
參數描述 |
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