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參數資料
型號: PSD933290MT
廠商: 意法半導體
英文描述: High Speed CMOS Logic Quad 2-Input NAND Gates with Open Drain 14-PDIP -55 to 125
中文描述: Flash在系統可編程ISP的外設的8位微控制器
文件頁數: 97/110頁
文件大小: 1737K
代理商: PSD933290MT
97/110
PSD813F2, PSD833F2, PSD834F2, PSD853F2, PSD854F2
Table 67. V
STBYON
Timing (5V devices)
Symbol
Note: 1. V
STBYON
timing is measured at V
CC
ramp rate of 2 ms.
Table 68. V
STBYON
Timing (3V devices)
Symbol
Note: 1. V
STBYON
timing is measured at V
CC
ramp rate of 2 ms.
Parameter
Conditions
Min
Typ
Max
Unit
t
BVBH
V
STBY
Detection to V
STBYON
Output High
(Note
1
)
20
μs
t
BXBL
V
STBY
Off Detection to V
STBYON
Output
Low
(Note
1
)
20
μs
Parameter
Conditions
Min
Typ
Max
Unit
t
BVBH
V
STBY
Detection to V
STBYON
Output High
(Note
1
)
20
μs
t
BXBL
V
STBY
Off Detection to V
STBYON
Output
Low
(Note
1
)
20
μs
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PDF描述
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