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參數資料
| 型號： | PSD934470JT |
| 廠商： | 意法半導體 |
| 英文描述： | Single Output LDO, 1.0A, Fixed(5.0V), Low Quiescent Current 8-SOIC -40 to 85 |
| 中文描述： | Flash在系統可編程ISP的外設的8位微控制器 |
| 文件頁數： | 29/110頁 |
| 文件大小： | 1737K |
| 代理商： | PSD934470JT |
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PSD813F2, PSD833F2, PSD834F2, PSD853F2, PSD854F2
SRAM
The SRAM is enabled when SRAM Select (RS0)
from the DPLD is High. SRAM Select (RS0) can
contain up to two product terms, allowing flexible
memory mapping.
The SRAM can be backed up using an external
battery. The external battery should be connected
to Voltage Stand-by (V
STBY
, PC2). If you have an
external battery connected to the PSD, the con-
tents of the SRAM are retained in the event of a
power loss. The contents of the SRAM are re-
tained so long as the battery voltage remains at
2 V or greater. If the supply voltage falls below the
battery voltage, an internal power switch-over to
the battery occurs.
PC4 can be configured as an output that indicates
when power is being drawn from the external bat-
tery. Battery-on Indicator (VBATON, PC4) is High
with the supply voltage falls below the battery volt-
age and the battery on Voltage Stand-by (V
STBY
,
PC2) is supplying power to the internal SRAM.
SRAM Select (RS0), Voltage Stand-by (V
STBY
,
PC2) and Battery-on Indicator (VBATON, PC4)
are all configured using PSDsoft Express Configu-
ration.
相關PDF資料 |
PDF描述 |
|---|---|
| PSD934470MIT | Single Output LDO, 1.0A, Fixed(5.0V), Low Quiescent Current 8-SOIC -40 to 85 |
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| PSD934490MIT | Single Output LDO, 1.0A, Adj.(1.22 to 8.85V), Low Quiescent Current 8-SOIC -40 to 85 |
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