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參數資料
| 型號： | PSD953270MT |
| 廠商： | 意法半導體 |
| 英文描述： | High Speed CMOS Logic Quad Two-Input NOR Gates 14-PDIP -55 to 125 |
| 中文描述： | Flash在系統可編程ISP的外設的8位微控制器 |
| 文件頁數： | 86/110頁 |
| 文件大小： | 1737K |
| 代理商： | PSD953270MT |
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PSD813F2, PSD833F2, PSD834F2, PSD853F2, PSD854F2
86/110
Figure 44. Input Macrocell Timing (product term clock)
Table 53. Input Macrocell Timing (5V devices)
Note: 1. Inputs from Port A, B, and C relative to register/ latch clock from the PLD. ALE/AS latch timings refer to t
AVLX
and t
LXAX
.
Table 54. Input Macrocell Timing (3V devices)
Note: 1. Inputs from Port A, B, and C relative to register/latch clock from the PLD. ALE latch timings refer to t
AVLX
and t
LXAX
.
Symbol
Parameter
Conditions
-70
-90
-15
PT
Aloc
Turbo
Off
Unit
Min
Max
Min
Max
Min
Max
t
IS
Input Setup Time
(Note
1
)
0
0
0
ns
t
IH
Input Hold Time
(Note
1
)
15
20
26
+ 10
ns
t
INH
NIB Input High Time
(Note
1
)
9
12
18
ns
t
INL
NIB Input Low Time
(Note
1
)
9
12
18
ns
t
INO
NIB Input to Combinatorial
Delay
(Note
1
)
34
46
59
+ 2
+ 10
ns
Symbol
Parameter
Conditions
-12
-15
-20
PT
Aloc
Turbo
Off
Unit
Min
Max
Min
Max
Min
Max
t
IS
Input Setup Time
(Note
1
)
0
0
0
ns
t
IH
Input Hold Time
(Note
1
)
25
25
30
+ 20
ns
t
INH
NIB Input High Time
(Note
1
)
12
13
15
ns
t
INL
NIB Input Low Time
(Note
1
)
12
13
15
ns
t
INO
NIB Input to Combinatorial
Delay
(Note
1
)
46
62
70
+ 4
+ 20
ns
t
INH
t
INL
t
INO
t
IH
t
IS
PT CLOCK
INPUT
OUTPUT
AI03101
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PDF描述 |
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| PSD954F2V-90J | 功能描述:SPLD - 簡單可編程邏輯器件 5.0V 2M 90ns RoHS:否 制造商:Texas Instruments 邏輯系列:TICPAL22V10Z 大電池數量:10 最大工作頻率:66 MHz 延遲時間:25 ns 工作電源電壓:4.75 V to 5.25 V 電源電流:100 uA 最大工作溫度:+ 75 C 最小工作溫度:0 C 安裝風格:Through Hole 封裝 / 箱體:DIP-24 |
| PSD954F2V-90M | 功能描述:SPLD - 簡單可編程邏輯器件 PQFP-52 3V 2M 90NS RoHS:否 制造商:Texas Instruments 邏輯系列:TICPAL22V10Z 大電池數量:10 最大工作頻率:66 MHz 延遲時間:25 ns 工作電源電壓:4.75 V to 5.25 V 電源電流:100 uA 最大工作溫度:+ 75 C 最小工作溫度:0 C 安裝風格:Through Hole 封裝 / 箱體:DIP-24 |
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