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參數資料
| 型號： | SB80C188EC20 |
| 元件分類： | 微處理器 |
| 英文描述： | MICROPROCESSOR|16-BIT|CMOS|QFP|100PIN|PLASTIC |
| 中文描述： | 微處理器| 16位|的CMOS | QFP封裝| 100引腳|塑料 |
| 文件頁數： | 31/57頁 |
| 文件大?。?/td> | 585K |
| 代理商： | SB80C188EC20 |
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80C186EC/188EC, 80L186EC/188EC
AC SPECIFICATIONS
AC CharacteristicsD80C186EC25
(Continued)
Symbol
Parameter
25 MHz
Units
Notes
Min
Max
SYNCHRONOUS INPUTS
T
CHIS
TEST, NMI, INT4:0, BCLK1:0, T1:0IN, READY, CTS1:0,
P2.6, P2.7
10
ns
1, 9
T
CHIH
TEST, NMI, INT4:0, BCLK1:0, T1:0IN, READY, CTS1:0
3
ns
1, 9
T
CLIS
AD15:0 (AD7:0), READY
10
ns
1, 10
T
CLIH
READY, AD15:0 (AD7:0)
3
ns
1, 10
T
CLIS
HOLD, PEREQ, ERROR
10
ns
1, 9
T
CLIH
HOLD, PEREQ, ERROR
3
ns
1, 9
NOTES:
1. See
AC Timing Waveforms
, for waveforms and definition.
2. Measure at V
IH
for high time, V
IL
for low time.
3. Only required to guarantee I
CC
. Maximum limits are bounded by T
C
, T
CH
and T
CL
.
4. Specified for a 50 pF load, see Figure 13 for capacitive derating information.
5. Specified for a 50 pF load, see Figure 14 for rise and fall times outside 50 pF.
6. See Figure 14 for rise and fall times.
7. T
CHOV1
applies to BHE (RFSH), LOCK and A19:16 only after a HOLD release.
8. T
CHOV2
applies to RD and WR only after a HOLD release.
9. Setup and Hold are required to guarantee recognition.
10. Setup and Hold are required for proper operation.
31
相關PDF資料 |
PDF描述 |
|---|---|
| SB80C188EC-20 | 16-Bit Microprocessor |
| SB80C188EC-25 | 16-Bit Microprocessor |
| SB80L186EC13 | MICROPROCESSOR|16-BIT|CMOS|QFP|100PIN|PLASTIC |
| SB80L186EC-13 | 16-Bit Microprocessor |
| SB80L188EC13 | MICROPROCESSOR|16-BIT|CMOS|QFP|100PIN|PLASTIC |
相關代理商/技術參數 |
參數描述 |
|---|---|
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