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參數資料
| 型號： | SPAKXC309VL100A |
| 廠商： | FREESCALE SEMICONDUCTOR INC |
| 元件分類： | 數字信號處理 |
| 英文描述： | 24-BIT, 100 MHz, OTHER DSP, PBGA196 |
| 封裝： | 15 X 15 MM, 1 MM PITCH, MOLD ARRAY PROCESS, BGA-196 |
| 文件頁數： | 1/112頁 |
| 文件大小： | 2288K |
| 代理商： | SPAKXC309VL100A |
當前第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁第109頁第110頁第111頁第112頁
Technical Data
Advance Information
DSP56309/D
Rev. 3, 9/2002
24-Bit Digital Signal
Processor
Figure 1. DSP56309 Block Diagram
PLL
OnCE
Clock
Generator
Internal
Data
Bus
Switch
YAB
XAB
PAB
YDB
XDB
PDB
GDB
MODB/IRQB
MODC/IRQC
External
Data Bus
Switch
13
MODD/IRQD
DSP56300
6
16
24-Bit
24
18
DDB
DAB
Peripheral
Core
YM
_
E
B
XM
_
E
B
PM
_
E
B
P
IO_
E
B
Expansion Area
6
JTAG
5
3
RESET
MODA/IRQA
PINIT/NMI
2
Bootstrap
ROM
EXTAL
XTAL
Address
Control
Data
Address
Generation
Unit
Six-Channel
DMA Unit
Program
Interrupt
Controller
Program
Decode
Controller
Program
Address
Generator
Data ALU
24
× 24 + 56 → 56-bit MAC
Two 56-bit Accumulators
56-bit Barrel Shifter
Power
Management
External
Bus
Interface
and Inst.
Cache
Control
External
Address
Bus
Switch
Memory Expansion Area
DE
X Data
RAM
7168
× 24
bits
(default)
Y Data
RAM
7168
× 24
bits
(default)
Triple
Timer
HI08
ESSI
SCI
PrograM
20480
× 24
bits
(default)
RAM
The DSP56309 is
intended for
applications benefiting
from a large amount of
on-chip memory, such
as wireless
infrastructure
applications.
The DSP56309 is a member of the DSP56300
core family of programmable CMOS digital
signal processors (DSPs). The DSP56300 core
includes a barrel shifter, 24-bit addressing, an
instruction cache, and direct memory access
(DMA). The DSP56309 offers 100 MIPS at
3.0–3.6 V using an internal 100 MHz clock.
The large on-chip memory is ideal for
wireless infrastructure and wireless local-loop
applications. The DSP56300 core family
offers a new level of performance in speed
and power provided by its rich instruction set
and low-power dissipation, thus enabling a
new generation of wireless, multimedia, and
telecommunications products.
Note: This document contains information on a new product. Specifications and information herein are subject to change without notice.
相關PDF資料 |
PDF描述 |
|---|---|
| SPAKXCF333CFT25 | 32-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP160 |
| SPAKXCF333MFT25 | 32-BIT, FLASH, 25 MHz, MICROCONTROLLER, PQFP160 |
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| SPC5516EBVLQ66R | 32-BIT, FLASH, 66 MHz, MICROCONTROLLER, PQFP144 |
| SPC5516EBVLQ48R | 32-BIT, FLASH, 66 MHz, MICROCONTROLLER, PQFP144 |
相關代理商/技術參數 |
參數描述 |
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