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參數(shù)資料
| 型號： | SY10EP31VKCTR |
| 廠商： | MICREL INC |
| 元件分類： | 通用總線功能 |
| 英文描述： | 5V/3.3V, 3GHz PECL/LVPECL D FLIP-FLOP WITH SET AND RESET |
| 中文描述： | 10E SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PDSO8 |
| 封裝： | 3 MM, MSOP-8 |
| 文件頁數(shù)： | 1/6頁 |
| 文件大小： | 81K |
| 代理商： | SY10EP31VKCTR |
1
ECL Pro
SY10EP31V
FINAL
Micrel
Pin
Function
CLK
ECL Clock Inputs
RESET
ECL Asynchronous Reset
SET
ECL Asynchronous Set
D
ECL Data Input with Internal 75k
Pull-Down
Resistor, Default State is LOW.
Q, /Q
ECL Data Outputs
V
CC
V
EE
Positive Supply
Negative, 0 Supply
DESCRIPTION
I
Guaranteed >3GHz bandwidth over temperature
I
Guaranteed <440ps propagation delay
I
3.3V and 5V power supply options
I
Wide operating temperature range: –40
°
C to +85
°
C
I
Available in 8-pin (3mm) MSOP and SOIC package
The SY10EP31V is a D flip-flop with set and reset.
The device is pin and functionally equivalent to the EL31
and LVEL31 devices. With AC performance much faster
than the EL31 and LVEL31 devices, the EP31V is ideal
for applications requiring the fastest AC performance
available. Both SET and RESET inputs are asynchronous,
level triggered signals. Data enters the master portion of
the flip-flop when CLK is low and is transferred to the
slave, and thus the outputs, upon a positive transition of
the CLK.
FEATURES
5V/3.3V, 3GHz PECL/LVPECL
D FLIP-FLOP WITH SET AND RESET
PIN NAMES
PIN CONFIGURATION/BLOCK DIAGRAM
Rev.: C
Issue Date:
Amendment: /0
March 2003
1
SET
D
CLK
RESET
8
VCC
Q
/Q
VEE
7
6
5
2
3
4
Flip
Flop
R
D
S
8-Pin MSOP and SOIC Packages
D
SET
RESET
CLK
Q
L
L
L
Z
L
H
L
L
Z
H
X
H
L
X
H
X
L
H
X
L
X
H
H
X
UNDEF
Z = LOW to HIGH Transition
TRUTH TABLE
ECL Pro
ECL Pro is a trademark of Micrel, Inc.
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PDF描述 |
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