參數資料
| 型號： | SY10EP51VZI TR |
| 廠商： | Micrel Inc |
| 文件頁數： | 1/8頁 |
| 文件大小： | 0K |
| 描述： | IC FLIP FLOP D 3.3V/5V 8-SOIC |
| 標準包裝： | 1,000 |
| 系列： | 10EP |
| 功能： | 復位 |
| 類型： | D 型 |
| 輸出類型： | 差分 |
| 元件數： | 1 |
| 每個元件的位元數： | 1 |
| 頻率 - 時鐘： | 3GHz |
| 延遲時間 - 傳輸： | 320ps |
| 觸發器類型： | 正，負 |
| 電源電壓： | 3 V ~ 5.5 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 8-SOIC（0.154"，3.90mm 寬） |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | SY10EP51VZITR SY10EP51VZITR-ND |
1
ECL Pro
SY10EP51V
Micrel, Inc.
M9999-060409
hbwhelp@micrel.com or (408) 955-1690
Pin
Function
CLK, /CLK
ECL Clock Inputs
RESET
ECL Asynchronous Reset
D
ECL Data Input
Q, /Q
ECL Data Outputs
VCC
Positive Supply
VEE
Negative, 0 Supply
DESCRIPTION
■ 3.3V and 5V power supply options
■ 320ps typical propagation delay
■ Maximum frequency > 3GHz typical
■ 75
K internal input pulldown resistor
■ Transistor count: 143
■ Available in 8-Pin (3mmx3mm) MSOP, SOIC and
MLF (2mmx2mm) packages
The SY10EP51V is a D flip-flop with reset and
differential clock. The device is pin and functionally
equivalent to the EL51 device.
The reset input is an asynchronous, level triggered
signal. Data enters the master portion of the flip-flop
when CLK is LOW and is transferred to the slave, and
thus the outputs, upon a positive transition of the CLK.
The differential clock inputs of the EP51V allow the device
to be used as a negative edge triggered flip-flop.
The differential input employs clamp circuitry to
maintain stability under open input conditions. When left
open, the CLK input will be pulled down to VEE and the
/CLK input will be biased a VCC/2.
FEATURES
5V/3.3V D FLIP-FLOP WITH RESET
AND DIFFERENTIAL CLOCK
PIN NAMES
ECL Pro
SY10EP51V
Rev.: E
Amendment: /0
Issue Date:
June 2009
TRUTH TABLE
D
RESET
CLK
Q
LL
Z
L
HL
Z
H
XH
X
L
Z = LOW to HIGH Transition
ECL Pro
ECL Pro is a registered trademark of Micrel, Inc.
相關PDF資料 |
PDF描述 |
|---|---|
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| SY10EP51VZI | IC FLIP FLOP D 3.3V/5V 8-SOIC |
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相關代理商/技術參數 |
參數描述 |
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