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參數資料
| 型號： | SY10H842 |
| 廠商： | Micrel Semiconductor,Inc. |
| 英文描述： | SINGLE SUPPLY QUAD PECL-TO-TTL OUTPUT ENABLE |
| 中文描述： | 單電源四路PECL到TTL輸出使能 |
| 文件頁數： | 1/6頁 |
| 文件大小： | 81K |
| 代理商： | SY10H842 |
Pin
Function
G
T
TTL Ground (0V)
V
T
TTL V
CC
(+5.0V)
V
E
ECL V
CC
(+5.0V)
G
E
ECL Ground (0V)
D, D
Signal Input (PECL)
V
BB
V
BB
Reference Output (PECL)
Q
0
- Q
3
Signal Outputs (TTL)
EN
Enable Input (PECL)
DESCRIPTION
FEATURES
ClockWorks
SY10H842
SY100H842
I
Translates positive ECL-to-TTL (PECL-to-TTL)
I
300ps pin-to-pin skew
I
500ps part-to-part skew
I
Differential internal design for increased noise
immunity and stable threshold inputs
I
V
BB
reference output
I
Single supply
I
Enable input
I
Extra TTL and ECL power/ground pins to reduce
cross-talk/noise
I
High drive capability: 24mA each output
I
Fully compatible with industry standard 10K, 100K
I/O levels
I
Available in 16-pin SOIC package
The SY10/100H842 are single supply, low skew
translating 1:4 clock drivers.
The devices feature a 24mA TTL output stage, with
AC performance specified into a 50pF load capacitance.
A HIGH on the enable pin (EN) forces all outputs LOW.
As frequencies increase to 40MHz and above, precise
timing and shaping of clock signals becomes extremely
important. The H842 solves several clock distribution
problems such as minimizing skew 300ps), maximizing
clock fanout (24mA drive), and precise duty cycle control
through a proprietary differential internal design.
The 10K version is compatible with 10KH ECL logic
levels. The 100K version is compatible with 100K levels.
PIN CONFIGURATION
SINGLE SUPPLY
QUAD PECL-TO-TTL
OUTPUT ENABLE
PIN NAMES
BLOCK DIAGRAM
D
D
Q
0
Q
1
Q
2
Q
3
V
BB
EN
ECL Input
TTL Outputs
Rev.: E
Issue Date: August, 1999
Amendment: /1
G
T
Q
3
SOIC
Z16-1
1
16
G
T
2
15
G
E
V
E
Q
2
3
14
V
T
4
13
V
T
5
12
Q
1
6
11
V
BB
G
T
7
10
G
T
Q
0
8
9
EN
D
D
1
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PDF描述 |
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