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參數(shù)資料
| 型號： | TFRA28J133BAL-1 |
| 元件分類： | TVS-瞬態(tài)抑制二極管 |
| 英文描述： | Transient Voltage Suppressor Diodes |
| 中文描述： | 電信提供商/數(shù)據(jù)通信 |
| 文件頁數(shù)： | 171/784頁 |
| 文件大小： | 10831K |
| 代理商： | TFRA28J133BAL-1 |
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Data Sheet
June 2002
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
171
Agere Systems Inc.
10 VT/TU Mapper Registers
(continued)
Table 212. VT_TTUOH_CTL[1—28], Transmit TU Overhead Control Per Channel (R/W)
Table 213. VT_TAPSRIVAL[1—28], Transmit APS and Remote Indication Per Channel (R/W)
Table 214. VT_TSWOW[1—28], Transmit Software Overwrite Per Channel (R/W)
Address
Bit
Name
Function
Reset
Default
0x00
0x0
0x0
0x0
0x0
0x0
0x200F8
—
0x20113
15:11
10:9
8:7
6:5
4:3
2
RSVD
Reserved.
O Bit Insertion Control.
See
Table 578 on page 453
.
VT_Z7_INS[1—28][1:0]
Z7 Byte Insertion Control.
See
Table 577 on page 452
.
VT_Z6_INS[1—28][1:0]
Z6 Byte Insertion Control.
See
Table 576 on page 452
.
VT_J2_INS[1—28][1:0]
J2 Byte Insertion Control.
See
Table 575 on page 452
.
VT_V5_INS[1—28]
V5 Byte Insertion Control.
Logic 1 forces the V5 byte to
be programmed via the LOPOH serial channel. See
Table 571 on page 450
.
VT_BIP2ERR_
INS[1—28][1:0]
page 450
.
VT_O_INS[1—28][1:0]
1:0
BIP-2 Error Insertion Control.
See
Table 572 on
0x0
Address
Bit
Name
Function
Reset
Default
0x0
0x0
0x20114
—
0x2012F
15:12
11:8
RSVD
VT_APS_
INS[1—28][3:0]
Reserved.
APS Software Overwrite Value.
This nibble is pro-
grammed to utilize APS bits in the Z7/K4 byte. This nibble
will be transmitted in bits 1:4 of the Z7/K4 byte.
Reserved.
Enhanced RDI-V Software Overwrite Values.
If
VT_ERDI_EN[1—28] (
Table 211 on page 170
) is a logic 1,
these bits are written into the ERDI-V locations of the Z7
byte.
RDI-V Software Overwrite Values.
If VT_RDI_EN[1—28]
(
Table 211 on page 170
) is a logic 1, this value will be writ-
ten into the RDI-V location of the V5 byte.
RFI-V Software Overwrite Values.
If VT_RFI_EN[1—28]
(
Table 211 on page 170
) is a logic 1, this value will be writ-
ten into the RFI-V location of the V5 byte.
7:5
4:2
RSVD
VT_ERDI_
INS[1—28][2:0]
0x0
0x0
1
VT_RDI_INS[1—28]
0x0
0
VT_RFI_INS[1—28]
0x0
Address
Bit
Name
Function
Reset
Default
0x00
0x20130
—
0x2014B
15:8
VT_OBIT_
INS[1—28][7:0]
Overhead Values for Software Overwrite in Asynchro-
nous Mappings.
This byte is programmed to utilize the
overhead bits in asynchronous VT/TU mappings.
VT_OBIT_INS[7:4] will be transmitted in the byte following
J2, and VT_OBIT_INS[3:0] will be transmitted in the byte
following Z6/N2.
Z6 Software Overwrite Values.
This byte is programmed
into the outgoing Z6/N2 location when
VT_Z6_INS[1—28][1:0] (
Table 212 on page 171
) = 01.
7:0
VT_Z6BYTE_
INS[1—28][7:0]
0x00
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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| TN0524N3 | TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92 |
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參數(shù)描述 |
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