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參數資料
| 型號： | TFRA28J133BAL-1 |
| 元件分類： | TVS-瞬態抑制二極管 |
| 英文描述： | Transient Voltage Suppressor Diodes |
| 中文描述： | 電信提供商/數據通信 |
| 文件頁數： | 618/784頁 |
| 文件大小： | 10831K |
| 代理商： | TFRA28J133BAL-1 |
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618
Agere Systems Inc.
TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
26 Applications
(continued)
VT Mapper
I
Receive data from SPEMPR: falling edge.
I
Transmit data to SPEMPR: rising edge.
M13/M23
I
When cross-connected to the DS3 device pins, DS3POSDATAOUT (Pin R22) and DS3NEGDATAOUT
(Pin P22) are clocked out on the falling edge of DS3DATAOUTCLK (Pin N22). If the M13 DS3 interface is
optioned for loop timing (M13_LOOP_TIME = 1), the DS3 data is clocked out on the rising edge of
DS3DATAINCLK (Pin J22).
26.22.3 Fixed Clock Edges Used Internally
SPE
I
Receive data from VT mapper: positive edge.
I
Transmit data to VT mapper: positive edge.
VT Mapper
I
Transmit data to PDH side: rising edge.
M13/M23
I
Transmit data to SPE: rising edge.
26.22.4 Frequently Asked Questions
Question 1
The active clock edges at most interfaces between different blocks could be configured through registers. Are there
any requirements or guidelines to configure these active clock edges For example, should the active clock edges
be configured to be the same at the two sides at an interface between two blocks Should the active edges be set
opposite or would both ways work
Answer
Generally speaking, it is highly recommended to use the opposite clock edges in order to clock-in data in the center
of the bit.
Question 2
For the configurable clock edges, related to transfers from/to primary I/O, how does one determine which clock
edge is to be used
Answer
This depends on the external delay to/from the external source. It is better to use the clock edge opposite to that of
the source signal to avoid possible delay of the data; or the default settings could be used and the clock edge could
be adjusted.
相關PDF資料 |
PDF描述 |
|---|---|
| TN0200T-T1 | CA DUAL BANANA/DUAL BANANA 5' |
| TN0201T-T1 | TRANSISTOR SOT23 SMD MOSFET |
| TN0520N3 | TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0524N3 | TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0540N3 | TRANSISTOR | MOSFET | N-CHANNEL | 400V V(BR)DSS | 140MA I(D) | TO-92 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| TFRA84J13 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J131BL-3-DB | 制造商:LSI Corporation 功能描述:Framer DS0/DS1/DS2/DS3/E1/E2/E3 1.5V/3.3V 909-Pin BGA |
| TFRA84J13DS0 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS1 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
| TFRA84J13DS2 | 制造商:AGERE 制造商全稱:AGERE 功能描述:Ultraframer DS3/E3/DS2/E2/DS1/E1/DS0 |
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