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參數資料
型號： TMP320C6413GTS400
廠商： Texas Instruments, Inc.
元件分類： 數字信號處理
英文描述： Fixed-Point Digital Signal Processors
中文描述： 定點數字信號處理器
文件頁數： 4/140頁
文件大小： 1958K
代理商： TMP320C6413GTS400
Contents
4
April 2004
Revised May 2005
SPRS247E
Contents
Section
Page
1
Features
11
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2
Functional Overview
2.1
GTS and ZTS BGA Packages (Bottom View)
2.2
Description
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.3
Device Characteristics
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2.3.1
Functional Block Diagram
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.4
CPU (DSP Core) Description
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5
Memory Map Summary
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.5.1
L2 Architecture Expanded
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.6
Peripheral Register Descriptions
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
2.7
EDMA Channel Synchronization Events
2.8
Interrupt Sources and Interrupt Selector
2.9
Signal Groups Description
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
12
12
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16
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3
Device Configurations
3.1
Device Configuration at Device Reset
3.2
Peripheral Configuration at Device Reset
3.3
Peripheral Selection After Device Reset
3.4
Peripheral Configuration Lock
3.5
Device Status Register Description
3.6
JTAG ID Register Description
3.7
Multiplexed Pins
3.8
Debugging Considerations
3.9
Configuration Examples
3.10
Terminal Functions
3.11
Development Support
3.12
Device Support
3.12.1
Device and Development-Support Tool Nomenclature
3.12.2
Documentation Support
44
44
45
46
48
50
51
52
53
53
55
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68
68
70
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4
Peripherals Detailed Description (Device-Specific)
4.1
Clock PLL and Oscillator
4.2
Host-Port Interface (HPI) Peripheral
4.3
Multichannel Audio Serial Port (McASP) Peripheral
4.3.1
McASP Block Diagram
4.4
I2C
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.5
General-Purpose Input/Output (GPIO)
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.6
Power-Down Modes Logic
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.6.1
Triggering, Wake-up, and Effects
4.6.2
C64x Power-Down Mode with an Emulator
4.7
Power-Supply Sequencing
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.7.1
Power-Supply Design Considerations
4.8
Power-Supply Decoupling
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
4.9
Peripheral Power-Down Operation
. . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . . .
71
71
75
76
76
78
79
82
82
84
84
84
85
86
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