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參數資料
| 型號： | TMXF281553BAL-3C-DB |
| 元件分類： | 通信、網絡模塊及開發工具 |
| 英文描述： | Telecomm/Datacomm |
| 中文描述： | 電信/數據通信 |
| 文件頁數： | 114/784頁 |
| 文件大小： | 10831K |
| 代理商： | TMXF281553BAL-3C-DB |
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TMXF28155 Supermapper
155/51 Mbits/s SONET/SDH x28/x21 DS1/E1
Data Sheet
June 2002
114
Agere Systems Inc.
8 TMUX Registers
(continued)
Table 125. TMUX_TBERINS_CTL, Transmit High-Speed Error Insertion Control Parameters (R/W)
Address
Bit
Name
Function
Reset
Default
0x0
0
0x40048
15:13
12
RSVD
Reserved.
Transmit Protection Signal Line REI Insert.
Con-
trol bit, when set to a logic 1, causes one line REI
error in the outgoing protection STS-3/STM-1 (AU-4)
signal when there is a rising edge observed on the
SMPR_BER_INSRT (
Table 75 on page 68
) input
signal.
Transmit Protection Signal B2 Error Insert.
Con-
trol bit, when set to a logic 1, causes one B2 error in
the outgoing protection STS-3/STM-1 (AU-4) signal
when there is a rising edge observed on the
SMPR_BER_INSRT (
Table 75 on page 68
) input
signal.
Transmit Path REI Error Insert.
Control bit, when
set to a logic 1, causes one path REI error in the out-
going STS-3/STM-1 (AU-4) signal. Only port 1 con-
trol is valid in AU-4 mode.
Transmit High-Speed B3 Error Insert.
Control bit,
when set to a logic 1, causes the output B3 byte in
the outgoing STS-3/STM-1 (AU-4) signal to be
inverted when there is a rising edge observed on the
SMPR_BER_INSRT (
Table 75 on page 68
) input
signal. Only port 1 control is valid in AU-4 mode.
Transmit High-Speed Line REI Insert.
Control bit,
when set to a logic 1, causes one line REI error in
the outgoing STS-3/STM-1 (AU-4) signal.
Transmit High-Speed B2 Error Insert.
Control bit,
when set to a logic 1, causes the output B2 bytes in
the outgoing STS-3/STM-1 (AU-4) signal to be
inverted when there is a rising edge observed on the
SMPR_BER_INSRT (
Table 75 on page 68
) input
signal.
Transmit High-Speed B1 Error Insert.
Control bit,
when set to a logic 1, causes the output B1 byte in
the outgoing STS-3/STM-1 (AU-4) signal to be
inverted when there is a rising edge observed on the
SMPR_BER_INSRT (
Table 75 on page 68
) input
signal.
TMUX_TPSLREIINS
11
TMUX_TPSB2EIINS
0
10:8
TMUX_TPREIINS[3:1]
0
7:5
TMUX_THSB3ERRINS[3:1]
0
4
TMUX_TLREIINS
0
3:1
TMUX_THSB2ERRINS[3:1]
000
0
TMUX_THSB1ERRINS
0
相關PDF資料 |
PDF描述 |
|---|---|
| TFRA28J133BAL-1 | Transient Voltage Suppressor Diodes |
| TN0200T-T1 | CA DUAL BANANA/DUAL BANANA 5' |
| TN0201T-T1 | TRANSISTOR SOT23 SMD MOSFET |
| TN0520N3 | TRANSISTOR | MOSFET | N-CHANNEL | 200V V(BR)DSS | 300MA I(D) | TO-92 |
| TN0524N3 | TRANSISTOR | MOSFET | N-CHANNEL | 240V V(BR)DSS | 300MA I(D) | TO-92 |
相關代理商/技術參數 |
參數描述 |
|---|---|
| TMXF336251BL-3-DB | 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag 制造商:LSI 功能描述:Mapper DS3/E3/DS0/E0 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 1152-Pin BGA Bag |
| TMXF84622 | 制造商:AGERE 制造商全稱:AGERE 功能描述:TMXF84622 155 Mbits/s/622 Mbits/s Interface SONET/SDH x84/x63 Ultramapper |
| TMXF846221BL-3-DB | 制造商:LSI Corporation 功能描述:Mapper DS3/E3/DS2/DS1/DS0/E1 SONET/SDH 155Mbps/622Mbps 1.5V/3.3V 700-Pin BGA Bag |
| TMXM-0-49 | 制造商:Brady Corporation 功能描述: |
| TMXM-11 | 制造商:Brady Corporation 功能描述: |
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