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參數資料
型號: TVP6000CPFP
廠商: TEXAS INSTRUMENTS INC
元件分類: 顏色信號轉換
英文描述: COLOR SIGNAL ENCODER, PQFP80
封裝: POWER, PLASTIC, TQFP-80
文件頁數: 26/57頁
文件大小: 268K
代理商: TVP6000CPFP
2–20
2.11.9
BLANK_LEVEL
Subaddress: 5E Default: 0xB8
7
6
5
4
3
2
1
0
GV8
BLANK[6:0]
Where:
GV8
The most significant bit of the GAIN_V register. See the GAIN_V register for more
information.
BLANK[6:0]Blank level setting for NTSC = 0x38 and for PAL = 0x3C.
2.11.10 GAIN_Y
Subaddress: 5F Default: 0x2E
7
6
5
4
3
2
1
0
GY(7–0)
Where:
GY[7:0]
Gain control of Y signal. The MSB, bit 8, is located at subaddress 60, bit 5.
In the case of NTSC with a 7.5 IRE pedestal, WHITE – BLACK = 92.5 IRE.
Gain_Y = 0x12E
In the case of no pedestal (PAL/SECAM), WHITE – BLACK = 100 IRE.
Gain_Y = 0x145
2.11.11 X_COLOR
Subaddress: 60 Default: 0x20
7
6
5
4
3
2
1
0
XC
GY8
LCD(2–0)
Cross color and chroma delay compensation register
Where:
XC
Cross color reduction enable for composite video output. Cross color does not affect
S-video output
0
Cross color reduction is disabled (default)
1
Cross color reduction is enabled
GY8
MSB of Gain_Y register.
LCD[2:0]
These three bits can be used for chroma channel delay compensation during S-video
mode. Table 2–10 shows the delay corresponding to the LCD[2:0] settings.
Table 2–10. Chroma Channel Delays
LCD[2:0]
DELAY ON CHROMA
CHANNEL
0
1
0.5 pixel clock period
0
1
0
1 pixel clock period
0
1
1.5 pixel clock period
1
x
2 pixel clock period
相關PDF資料
PDF描述
TVP7000PZPG4 SPECIALTY CONSUMER CIRCUIT, PQFP100
TVP7000PZPRG4 SPECIALTY CONSUMER CIRCUIT, PQFP100
TVP7000PZPR SPECIALTY CONSUMER CIRCUIT, PQFP100
TVP7000PZP SPECIALTY CONSUMER CIRCUIT, PQFP100
TVP7001PZPG4 SPECIALTY CONSUMER CIRCUIT, PQFP100
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