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參數資料
| 型號： | XP5601 |
| 廠商： | PANASONIC CORP |
| 元件分類： | 功率晶體管 |
| 英文描述： | Silicon PNP(NPN) epitaxial planer transistor |
| 中文描述： | 100 mA, 50 V, 2 CHANNEL, NPN AND PNP, Si, SMALL SIGNAL TRANSISTOR |
| 封裝： | ROHS COMPLIANT, SMINI6-G1, SC-88, 6 PIN |
| 文件頁數： | 1/5頁 |
| 文件大小： | 60K |
| 代理商： | XP5601 |
1
Composite Transistors
XP5601
Silicon PNP epitaxial planer transistor (Tr1)
Silicon NPN epitaxial planer transistor (Tr2)
For general amplification
I
Features
G
Two elements incorporated into one package.
G
Reduction of the mounting area and assembly cost by one half.
I
Basic Part Number of Element
G
2SB709A+2SD601A
I
Absolute Maximum Ratings
(Ta=25C)
Unit: mm
Marking Symbol:
4N
Internal Connection
1 : Emitter (Tr1)
2 : Base (Tr1)
3 : Base (Tr2)
4 : Collector (Tr2)
5 : Emitter (Tr2)
6 : Collector (Tr1)
EIAJ : SC–88
S–Mini Type Package (6–pin)
2.1
±
0.1
0
±
0
0
0
2
±
0
0
±
0
0
1.25
±
0.1
0.425
0.425
1
2
3
6
5
4
0.2
±
0.1
0
±
0
0
0
+
–
Parameter
Symbol
Ratings
Unit
Collector to base voltage
V
CBO
V
CEO
V
EBO
I
C
I
CP
V
CBO
V
CEO
V
EBO
I
C
I
CP
P
T
T
j
T
stg
–60
V
Collector to emitter voltage
–50
V
Emitter to base voltage
–7
V
Collector current
–100
mA
Peak collector current
–200
mA
Collector to base voltage
60
V
Collector to emitter voltage
50
V
Emitter to base voltage
7
V
Collector current
100
mA
Peak collector current
200
mA
Total power dissipation
150
mW
Junction temperature
150
C
Storage temperature
–55 to +150
C
Tr1
Overall
Tr2
1
6
5
Tr2
Tr1
2
3
4
相關PDF資料 |
PDF描述 |
|---|---|
| XP5A554 | Silicon NPN epitaxial planer transistor |
| XP6111 | Silicon PNP epitaxial planer transistor |
| XP6112 | Silicon PNP epitaxial planer transistor |
| XP6113 | Silicon PNP epitaxial planer transistor |
| XP6114 | Silicon PNP epitaxial planer transistor |
相關代理商/技術參數 |
參數描述 |
|---|---|
| XP560E-B652 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| XP560E-BG560 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| XP560E-CG1156 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| XP560E-F1020 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
| XP560E-F1156 | 制造商:未知廠家 制造商全稱:未知廠家 功能描述:FPGA |
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