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參數資料
| 型號： | 74LVC74APW,112 |
| 廠商： | NXP Semiconductors |
| 文件頁數： | 19/19頁 |
| 文件大小： | 0K |
| 描述： | IC FLIP FLOP DUAL D POS 14TSSOP |
| 產品培訓模塊： | Logic Packages |
| 標準包裝： | 2,400 |
| 系列： | 74LVC |
| 功能： | 設置（預設）和復位 |
| 類型： | D 型 |
| 輸出類型： | 差分 |
| 元件數： | 2 |
| 每個元件的位元數： | 1 |
| 頻率 - 時鐘： | 250MHz |
| 延遲時間 - 傳輸： | 2.5ns |
| 觸發器類型： | 正邊沿 |
| 輸出電流高，低： | 24mA，24mA |
| 電源電壓： | 1.2 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 125°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 14-TSSOP（0.173"，4.40mm 寬） |
| 包裝： | 管件 |
74LVC74A
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NXP B.V. 2012. All rights reserved.
Product data sheet
Rev. 7 — 20 November 2012
9 of 19
NXP Semiconductors
74LVC74A
Dual D-type flip-flop with set and reset; positive-edge trigger
11. AC waveforms
The shaded areas indicate when the input is permitted to change for predictable output performance.
Measurement points are given in Table 9.
VOL and VOH are typical output voltage levels that occur with the output load.
Fig 7.
The clock input (nCP) to output (nQ, nQ) propagation delays, the clock pulse width, the nD to nCP set-up,
the nCP to nD hold times, and the maximum frequency
mna422
th
tsu
th
tPHL
tW
tPLH
tsu
1/fmax
VM
VI
GND
VI
GND
nCP input
nD input
VOH
VOL
nQ output
VOH
VOL
nQ output
相關PDF資料 |
PDF描述 |
|---|---|
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相關代理商/技術參數 |
參數描述 |
|---|---|
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| 74LVC74APW-Q100J | 制造商:NXP Semiconductors 功能描述:Flip Flop D-Type Pos-Edge 2-Element 14-Pin TSSOP T/R 制造商:NXP Semiconductors 功能描述:74LVC74APW-Q100/TSSOP14/REEL13 - Tape and Reel 制造商:NXP Semiconductors 功能描述:IC FLIP-FLOP DUAL D POS 14TSSOP |
| 74LVC74APWR | 制造商:Texas Instruments 功能描述:DUAL POSITIVE-EDGE-TRIGGERED D-TYPE FLIP-FLOPS WITH CLEAR AND PRESET LOW VOLTAG |
| 74LVC74APW-T | 制造商:NXP Semiconductors 功能描述:Flip Flop D-Type Pos-Edge 2-Element 14-Pin TSSOP T/R |
| 74LVC821ABQ | 制造商:NXP Semiconductors 功能描述:IC 10BIT D F-F TRI-ST DHVQF |
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