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參數資料
| 型號： | 74LVX573MTR |
| 廠商： | 意法半導體 |
| 英文描述： | LOW VOLTAGE CMOS OCTAL D-TYPE LATCH (3-STATE NON INV.) WITH 5V TOLERANT INPUTS |
| 中文描述： | 低電壓CMOS八進制D型鎖存器（三態非刑事調查。容限為5V輸入） |
| 文件頁數： | 4/10頁 |
| 文件大小： | 201K |
| 代理商： | 74LVX573MTR |
74LVX573
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DYNAMIC SWITCHING CHARACTERISTICS
1) Worst case package.
2) Max number of outputs defined as (n). Data inputs are driven 0V to 3.3V, (n-1) outputs switching and one output at GND.
3) Max number of data inputs (n) switching. (n-1) switching 0V to 3.3V. Inputs under test switching: 3.3V to threshold (V
ILD
), 0V to threshold
(V
IHD
), f=1MHz.
AC ELECTRICAL CHARACTERISTICS
(Input t
r
= t
f
= 3ns)
1) Skew is defined as the absolute value of the difference between the actual propagation delay for any two outputs of the same device switch-
ing in the same direction, either HIGH or LOW
2) Parameter guaranteed by design
(*) Voltage range is 3.3V
±
0.3V
Symbol
Parameter
Test Condition
Value
Unit
V
CC
(V)
T
A
= 25°C
-40 to 85°C
-55 to 125°C
Min.
Typ.
Max.
Min.
Max.
Min.
Max.
V
OLP
Dynamic Low
Voltage Quiet
Output (note 1, 2)
Dynamic High
Voltage Input
(note 1, 3)
Dynamic Low
Voltage Input
(note 1, 3)
3.3
C
L
= 50 pF
0.3
0.8
V
V
OLV
-0.8
-0.3
V
IHD
3.3
2.0
V
ILD
3.3
0.8
Symbol
Parameter
Test Condition
Value
Unit
V
CC
(V)
C
L
(pF)
T
A
= 25°C
-40 to 85°C
-55 to 125°C
Min.
Typ.
Max.
Min.
Max.
Min.
Max.
t
PLH
t
PHL
Propagation Delay
Time
LE to Q
2.7
15
8.2
15.6
1.0
18.5
1.0
18.5
ns
2.7
3.3
(*)
3.3
(*)
50
10.7
19.1
1.0
22.0
1.0
22.0
15
6.4
10.1
1.0
12.0
1.0
12.0
50
8.9
13.6
1.0
15.5
1.0
15.5
t
PLH
t
PHL
Propagation Delay
Time
D to Q
2.7
15
7.6
14.5
1.0
17.5
1.0
17.5
ns
2.7
3.3
(*)
3.3
(*)
2.7
2.7
3.3
(*)
3.3
(*)
2.7
3.3
(*)
2.7
3.3
(*)
2.7
3.3
(*)
2.7
3.3
(*)
2.7
50
10.1
18.0
1.0
21.0
1.0
21.0
15
5.9
9.3
1.0
11.0
1.0
11.0
50
15
50
15
8.4
7.8
10.3
6.1
12.8
15.0
18.5
9.7
1.0
1.0
1.0
1.0
14.5
18.5
22.0
12.0
1.0
1.0
1.0
1.0
14.5
18.5
22.0
12.0
t
PZL
t
PZH
Output Enable
Time
ns
50
50
50
50
50
50
50
50
50
50
8.6
12.1
10.1
13.2
19.1
13.6
6.5
5.0
5.0
3.5
1.5
1.5
1.0
1.0
1.0
1.0
15.5
22.0
15.5
7.5
5.0
5.0
3.5
1.5
1.5
1.5
1.0
1.0
1.0
15.5
22.0
15.5
7.5
5.0
5.0
3.5
1.5
1.5
1.5
t
PLZ
t
PHZ
Output Disable
Time
ns
t
W
LE pulse Width,
HIGH
ns
t
S
Setup Time D to LE
HIGH or LOW
ns
t
h
Hold Time D to LE
HIGH or LOW
ns
t
OSLH
t
OSHL
Output to Output
Skew Time (note
1,2)
0.5
ns
3.3
(*)
50
0.5
1.0
1.5
1.5
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PDF描述 |
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參數描述 |
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| 74LVX573SJX | 功能描述:閉鎖 Octal Latch RoHS:否 制造商:Micrel 電路數量:1 邏輯類型:CMOS 邏輯系列:TTL 極性:Non-Inverting 輸出線路數量:9 高電平輸出電流: 低電平輸出電流: 傳播延遲時間: 電源電壓-最大:12 V 電源電壓-最小:5 V 最大工作溫度:+ 85 C 最小工作溫度:- 40 C 封裝 / 箱體:SOIC-16 封裝:Reel |
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