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參數資料
| 型號： | 74LVX573TTR |
| 廠商： | 意法半導體 |
| 英文描述： | LOW VOLTAGE CMOS OCTAL D-TYPE LATCH (3-STATE NON INV.) WITH 5V TOLERANT INPUTS |
| 中文描述： | 低電壓CMOS八進制D型鎖存器（三態非刑事調查。容限為5V輸入） |
| 文件頁數： | 2/10頁 |
| 文件大小： | 201K |
| 代理商： | 74LVX573TTR |
74LVX573
2/10
INPUT EQUIVALENT CIRCUIT
PIN DESCRIPTION
TRUTH TABLE
X : Don’t Care
Z : High Impedance
* : Q Outputs are Latched at the time when the LE INPUT is taken low logic level
LOGIC DIAGRAM
This logic diagram has not be used to estimate propagation delays
PIN No
SYMBOL
NAME AND FUNCTION
1
OE
3 State Output Enable
Input (Active LOW)
Data Inputs
2, 3, 4, 5, 6,
7, 8, 9
12, 13, 14,
15, 16, 17,
18, 19
11
10
20
D0 to D7
Q0 to Q7
3-State Latch Outputs
LE
GND
V
CC
Latch Enable Input
Ground (0V)
Positive Supply Voltage
INPUTS
OUTPUT
OE
LE
D
Q
H
L
L
L
X
L
H
H
X
X
L
H
Z
NO CHANGE*
L
H
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PDF描述 |
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