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參數資料
型號: A3PN060-FVQG100
元件分類: FPGA
英文描述: FPGA, 1536 CLBS, 60000 GATES, PQFP100
封裝: 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, VQFP-100
文件頁數: 38/92頁
文件大小: 3184K
代理商: A3PN060-FVQG100
ProASIC3 nano DC and Switching Characteristics
Ad vance v0.2
2-29
Table 2-44 1.8 V LVCMOS Low Slew
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 1.7 V
Software Default Load at 10 pF for A3PN020, A3PN015, A3PN010
Drive
Strength
Speed
Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
Std.
0.60
8.90
0.04
1.31
1.89
0.43
7.80
7.02
2.35
1.72
ns
–1
0.51
7.57
0.04
1.12
1.60
0.36
6.64
5.97
2.00
1.46
ns
–2
0.45
6.65
0.03
0.98
1.41
0.32
5.82
5.24
1.76
1.28
ns
4 mA
Std.
0.60
7.08
0.04
1.31
1.89
0.43
6.40
5.93
2.75
2.74
ns
–1
0.51
6.02
0.04
1.12
1.60
0.36
5.44
5.05
2.34
2.33
ns
–2
0.45
5.29
0.03
0.98
1.41
0.32
4.78
4.43
2.05
2.04
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-5 for derating
values.
Table 2-45 1.8 V LVCMOS High Slew
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 1.7 V
Software Default Load at 10 pF for A3PN020, A3PN015, A3PN010
Drive
Strength
Speed
Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
Std.
0.60
4.99
0.04
1.31
1.89
0.43
3.70
3.53
2.35
1.78
ns
–1
0.51
4.24
0.04
1.12
1.60
0.36
3.15
3.01
2.00
1.51
ns
–2
0.45
3.72
0.03
0.98
1.41
0.32
2.77
2.64
1.75
1.33
ns
4 mA
Std.
0.60
3.49
0.04
1.31
1.89
0.43
3.04
2.70
2.74
2.84
ns
–1
0.51
2.97
0.04
1.12
1.60
0.36
2.58
2.30
2.33
2.42
ns
–2
0.45
2.61
0.03
0.98
1.41
0.32
2.27
2.02
2.05
2.12
ns
Notes:
1. Software default selection highlighted in gray.
2. For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-5 for derating
values.
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PDF描述
A3PN060-ZFVQ100 FPGA, 1536 CLBS, 60000 GATES, PQFP100
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A3PN125-FVQ100 FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3PN125-FVQG100 FPGA, 3072 CLBS, 125000 GATES, PQFP100
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