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參數資料
型號: A3PN125-Z2VQG100
元件分類: FPGA
英文描述: FPGA, 3072 CLBS, 125000 GATES, PQFP100
封裝: 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, VQFP-100
文件頁數: 36/100頁
文件大小: 3284K
代理商: A3PN125-Z2VQG100
ProASIC3 nano DC and Switching Characteristics
2- 26
Advance v0.2
Table 2-38 2.5 V LVCMOS Low Slew
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 2.3 V
Software Default Load at 10 pF for A3PN020, A3PN015, A3PN010
Drive
Strength
Speed
Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
Std.
0.60
6.79
0.04
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1.61
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5.87
5.37
2.37
2.25
ns
–1
0.51
5.77
0.04
1.19
1.37
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5.00
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–2
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2.37
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ns
–1
0.51
5.77
0.04
1.19
1.37
0.36
5.00
4.56
2.02
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ns
–2
0.45
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4.01
1.77
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ns
6 mA
Std.
0.60
5.34
0.04
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0.43
4.79
4.55
2.70
2.87
ns
–1
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2.14
ns
8 mA
Std.
0.60
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0.51
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1.04
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0.32
3.58
3.40
2.01
2.14
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-5 for derating
values.
Table 2-39 2.5 V LVCMOS High Slew
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V, Worst-Case VCCI = 2.3 V
Software Default Load at 10 pF for A3PN020, A3PN015, A3PN010
Drive
Strength
Speed
Grade
tDOUT
tDP
tDIN
tPY
tPYS
tEOUT
tZL
tZH
tLZ
tHZ
Units
2 mA
Std.
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2.84
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2.34
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–1
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0.04
1.19
1.37
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2.69
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0.04
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2.69
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1.19
1.37
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1.68
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2.22
ns
Notes:
1. Software default selection highlighted in gray.
2. For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-5 for derating
values.
相關PDF資料
PDF描述
A3PN125-ZVQ100I FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3PN125-ZVQ100 FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3PN125-ZVQG100I FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3PN125-ZVQG100 FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3RS91.1 0 MHz - 3000 MHz 50 ohm RF/MICROWAVE TERMINATION
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參數描述
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