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參數資料
型號: A3PN125-Z2VQG100I
元件分類: FPGA
英文描述: FPGA, 3072 CLBS, 125000 GATES, PQFP100
封裝: 14 X 14 MM, 1.20 MM HEIGHT, 0.50 MM PITCH, ROHS COMPLIANT, VQFP-100
文件頁數: 77/100頁
文件大小: 3284K
代理商: A3PN125-Z2VQG100I
ProASIC3 nano DC and Switching Characteristics
2- 64
Advance v0.2
JTAG 1532 Characteristics
JTAG timing delays do not include JTAG I/Os. To obtain complete JTAG timing, add I/O buffer delays
to the corresponding standard selected; refer to the I/O timing characteristics in the "User I/O
Timing Characteristics
Table 2-74 JTAG 1532
Commercial-Case Conditions: TJ = 70°C, Worst-Case VCC = 1.425 V
Parameter
Description
–2
–1
Std.
Units
tDISU
Test Data Input Setup Time
0.53
0.60
0.71
ns
tDIHD
Test Data Input Hold Time
1.07
1.21
1.42
ns
tTMSSU
Test Mode Select Setup Time
0.53
0.60
0.71
ns
tTMDHD
Test Mode Select Hold Time
1.07
1.21
1.42
ns
tTCK2Q
Clock to Q (data out)
6.39
7.24
8.52
ns
tRSTB2Q
Reset to Q (data out)
21.31
24.15
28.41
ns
FTCKMAX
TCK Maximum Frequency
23.00
20.00
17.00
MHz
tTRSTREM
ResetB Removal Time
0.00
ns
tTRSTREC
ResetB Recovery Time
0.21
0.24
0.28
ns
tTRSTMPW
ResetB Minimum Pulse
TBD
ns
Note: For specific junction temperature and voltage supply levels, refer to Table 2-6 on page 2-5
for derating values.
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PDF描述
A3PN125-Z2VQG100 FPGA, 3072 CLBS, 125000 GATES, PQFP100
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A3PN125-ZVQ100 FPGA, 3072 CLBS, 125000 GATES, PQFP100
A3PN125-ZVQG100I FPGA, 3072 CLBS, 125000 GATES, PQFP100
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