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參數資料
型號： AD7729ARU
廠商： ANALOG DEVICES INC
元件分類： 模擬信號調理
英文描述： Dual Sigma-Delta ADC with Auxiliary DAC
中文描述： SPECIALTY ANALOG CIRCUIT, PDSO28
封裝： TSSOP-28
文件頁數： 4/16頁
文件大小： 142K
代理商： AD7729ARU
AD7729
–4–
REV. 0
TIMING CHARACTERISTICS
Limit at
T
A
= –40
8
C to +105
8
C
Parameter
Units
Description
AUXILIARY FUNCTIONS
Clock Signals
t
1
t
2
t
3
t
4
t
5
t
6
t
10
t
11
t
12
t
13
t
14
t
15
t
16
t
17
Receive Section
Clock Signals
t
7
t
8
t
9
t
18
t
19
t
20
t
21
t
22
t
23
t
24
t
25
See Figure 2.
MCLK Period
MCLK Width Low
MCLK Width High
ASCLK Period. See Figures 4 and 6.
ASCLK Width Low
ASCLK Width High
ASDI/ASDIFS Setup Before ASCLK Low
ASDI/ASDIFS Hold After ASCLK Low
ASDOFS Delay from ASCLK High
ASDOFS Hold After ASCLK High
ASDO Hold After ASCLK High
ASDO Delay from ASCLK High
ASDIFS Low to ASDI LSB Read by ASPORT
Interval Between Consecutive ASDIFS Pulses
76
30.4
30.4
t
1
0.4
×
t
1
0.4
×
t
1
20
10
15
0
0
15
10
t
4
+ 15
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns min
ns max
ns min
ns min
ns max
ns min
ns min
See Figures 5 and 7.
BSCLK Period
BSCLK Width Low
BSCLK Width High
BSDI/BSDIFS Setup Before BSCLK Low
BSDI/BSDIFS HoldAfter BSCLK Low
BSDOFS Delay from BSCLK High
BSDOFS Hold After BSCLK High
BSDO Hold After BSCLK High
BSDO Delay from BSCLK High
BSDIFS Low to ASDI LSB Read by BSPORT
Interval Between Consecutive BSDIFS Pulses
t
1
0.4
×
t
1
0.4
×
t
1
20
10
15
0
0
15
10
t
7
+ 15
ns min
ns min
ns min
ns min
ns min
ns max
ns min
ns min
ns max
ns min
ns min
ASCLK = MCLK/(2
×
ASCLKRATE). ASCLKRATE can have a value from 0 . . . 1023. When ASCLKRATE = 0, ASCLK = 13 MHz.
BSCLK = MCLK/(2
×
BSCLKRATE). BSCLKRATE can have a value from 0 . . . 1023. When BSCLKRATE = 0, BSCLK = 13 MHz.
Specifications subject to change without notice.
(AVDD1 = AVDD2 = +3 V
6
10%; DVDD1 = DVDD2 = +3 V
6
10%; AGND = DGND = 0 V;
T
A
= T
MIN
to T
MAX
, unless otherwise noted)
Table II. Receive Section Signal Ranges
Baseband Section
Signal Range
1.3 V
±
5%
1.3 V
±
10%
V
REFCAP
V
REFOUT
ADC
ADC Signal Range
V
BIAS
Differential Input
Single-Ended Input
Signal Range
Differential
Single-Ended
2 V
REFCAP
V
REFCAP
/2 to (AVDD1 – V
REFCAP
/2)
V
REFCAP
to (AVDD1 – V
REFCAP
)
V
BIAS
±
V
REFCAP
/2
V
BIAS
±
V
REFCAP
Table III. Auxiliary Section Signal Ranges
AUXDAC
Signal Range
Output Code
Code 000
Code 3FF
2/32
×
V
REFCAP
2 V
REFCAP
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PDF描述
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AD7730LBRU Bridge Transducer ADC
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參數描述
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AD7729ARU-REEL7 功能描述:IC ADC 15BIT DUAL W/DAC 28-TSSOP RoHS:否 類別:集成電路 (IC) >> 數據采集 - ADCs/DAC - 專用型 系列:- 產品培訓模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標準包裝:50 系列:- 類型:數據采集系統（DAS） 分辨率（位）:16 b 采樣率（每秒）:21.94k 數據接口:MICROWIRE?，QSPI?，串行，SPI? 電壓電源:模擬和數字 電源電壓:1.8 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:40-WFQFN 裸露焊盤 供應商設備封裝:40-TQFN-EP（6x6） 包裝:托盤
AD7729ARUZ 功能描述:IC ADC 15BIT DUAL W/DAC 28TSSOP RoHS:是 類別:集成電路 (IC) >> 數據采集 - ADCs/DAC - 專用型 系列:- 產品培訓模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標準包裝:50 系列:- 類型:數據采集系統（DAS） 分辨率（位）:16 b 采樣率（每秒）:21.94k 數據接口:MICROWIRE?，QSPI?，串行，SPI? 電壓電源:模擬和數字 電源電壓:1.8 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:40-WFQFN 裸露焊盤 供應商設備封裝:40-TQFN-EP（6x6） 包裝:托盤
AD7729ARUZ-REEL 功能描述:IC ADC 15BIT DUAL W/DAC 28TSSOP RoHS:是 類別:集成電路 (IC) >> 數據采集 - ADCs/DAC - 專用型 系列:- 產品培訓模塊:Lead (SnPb) Finish for COTS Obsolescence Mitigation Program 標準包裝:50 系列:- 類型:數據采集系統（DAS） 分辨率（位）:16 b 采樣率（每秒）:21.94k 數據接口:MICROWIRE?，QSPI?，串行，SPI? 電壓電源:模擬和數字 電源電壓:1.8 V ~ 3.6 V 工作溫度:-40°C ~ 85°C 安裝類型:表面貼裝 封裝/外殼:40-WFQFN 裸露焊盤 供應商設備封裝:40-TQFN-EP（6x6） 包裝:托盤
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