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參數(shù)資料
| 型號： | AD8151-EVAL |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | GPA/SK 300X280X1,5... |
| 中文描述： | 33 × 17，3.2 Gb / s的數(shù)字交叉點(diǎn)開關(guān) |
| 文件頁數(shù)： | 13/36頁 |
| 文件大?。?/td> | 5326K |
| 代理商： | AD8151-EVAL |
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AD8151
–13–
REV. 0
Control Interface Timing Diagrams
CS
INPUT
t
ASW
t
AHW
t
DSW
WE
INPUT
A[4:0] INPUTS
D[6:0] INPUTS
t
CSW
t
WP
t
CHW
t
DHW
Figure 3. First Rank Write Cycle
Table III. First Rank Write Cycle
Symbol
Parameter
Conditions
T
A
= 25
°
C
V
DD
= 5 V
V
CC
= 3.3 V
Min
Typ
Max
Unit
t
CSW
t
ASW
t
DSW
t
CHW
t
AHW
t
DHW
t
WP
Setup Time
Chip Select to Write Enable
Address to Write Enable
Data to Write Enable
0
0
15
ns
ns
ns
Hold Time
Chip Select from Write Enable
Address from Write Enable
Data from Write Enable
0
0
0
ns
ns
ns
Width of Write Enable Pulse
15
ns
PREVIOUS RANK 2 DATA
CS
INPUT
UPDATE
INPUT
ENABLING
OUT[0:16][N:P]
OUTPUTS
TOGGLE
OUT[0:16][N:P]
OUTPUTS
DISABLING
OUT[0:16][N:P]
OUTPUTS
DATA FROM RANK 1
t
CSU
t
UOE
t
CHU
DATA FROM RANK 1
DATA FROM RANK 2
t
UW
t
UOD
t
UOT
Figure 4. Second Rank Update Cycle
Table IV. Second Rank Update Cycle
Symbol
Parameter
Conditions
T
A
= 25
°
C
V
DD
= 5 V
V
CC
= 3.3 V
Min
Typ
Max
Unit
t
CSU
t
CHU
t
UOE
t
UOT
t
UOD
t
UW
Setup Time
Hold Time
Output Enable Times
Output Toggle Times
Output Disable Times
Chip Select to Update
Chip Select from Update
Update to Output Enable
Update to Output Reprogram
Update to Output Disabled
0
0
ns
ns
ns
ns
ns
25
25
25
40
40
30
Width of Update Pulse
15
ns
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| AD8151 | 33 x 17, 3.2 Gb/s Digital Crosspoint Switch |
| AD8151AST | 33 x 17, 3.2 Gb/s Digital Crosspoint Switch |
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| AD8156ABCZ | 6.25 Gbps 4】4 Digital Crosspoint Switch with EQ |
| AD8156-EVALZ | 6.25 Gbps 4】4 Digital Crosspoint Switch with EQ |
相關(guān)代理商/技術(shù)參數(shù) |
參數(shù)描述 |
|---|---|
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