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參數資料
| 型號： | AD8300 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | +3 Volt, Serial Input Complete 12-Bit DAC(串行輸入完備的12位D/A轉換器) |
| 中文描述： | 3伏，串行輸入完整的12位DAC（串行輸入完備的12位的D / A轉換器） |
| 文件頁數： | 3/8頁 |
| 文件大小： | 328K |
| 代理商： | AD8300 |
+5 V OPERATION
Parameter
Symbol
Condition
Min
Typ
Max
Units
STATIC PERFORMANCE
Resolution
Relative Accuracy
Differential Nonlinearity
2
Zero-Scale Error
Full-Scale Voltage
3
Full-Scale Tempco
N
INL
DNL
V
ZSE
V
FS
TCV
FS
[Note 1]
12
–2
–1
Bits
LSB
LSB
mV
Volts
ppm/
°
C
±
1/2
±
1/2
+1/2
+2
+1
+3
Monotonic
Data = 000
H
Data = FFF
H
[Notes 3, 4]
2.039 2.0475 2.056
16
ANALOG OUTPUT
Output Current (Source)
Output Current (Sink)
Load Regulation
Output Resistance to GND
Capacitive Load
I
OUT
I
OUT
L
REG
R
OUT
C
L
Data = 800
H
,
V
OUT
= 5 LSB
Data = 800
H
,
V
OUT
= 5 LSB
R
L
= 200
to
∞
, Data = 800
H
Data = 000
H
No Oscillation
4
5
2
5
mA
mA
LSB
pF
1.5
30
500
LOGIC INPUTS
Logic Input Low Voltage
Logic Input High Voltage
Input Leakage Current
Input Capacitance
V
IL
V
IH
I
IL
C
IL
0.8
V
V
μ
A
pF
2.4
10
10
INTERFACE TIMING
SPECIFICATIONS
4, 5
Clock Width High
Clock Width Low
Load Pulse Width
Data Setup
Data Hold
Clear Pulse Width
Load Setup
Load Hold
Select
Deselect
t
CH
t
CL
t
LDW
t
DS
t
DH
t
CLWR
t
LD1
t
LD2
t
CSS
t
CSH
30
30
30
15
15
30
15
30
30
30
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
AC CHARACTERISTICS
4
Voltage Output Settling Time
Voltage Output Settling Time
Output Slew Rate
DAC Glitch
Digital Feedthrough
t
S
t
S
SR
To
±
0.2% of Full Scale
To
±
1 LSB of Final Value
5
Data = 000
H
to FFF
H
to 000
H
6
13
2.2
15
15
μ
s
μ
s
V/
μ
s
nV/s
nV/s
SUPPLY CHARACTERISTICS
Power Supply Range
Positive Supply Current
Positive Supply Current
Power Dissipation
Power Supply Sensitivity
V
DD RANGE
I
DD
I
DD
P
DISS
PSS
DNL <
±
1 LSB
V
DD
= 5 V, V
IL
= 0 V,Data = 000
H
V
DD
= 5.5 V, V
IH
= 2.3 V, Data = FFF
H
V
DD
= 5 V, V
IL
= 0 V, Data = 000
H
V
DD
=
±
10%
2.7
5.5
1.7
4.0
5.1
0.006
V
mA
mA
mW
%/%
1.2
2.8
6
0.001
NOTES
1
1 LSB = 0.5 mV for 0 V to +2.0475 V output range.
2
The first two codes (000
H
, 001
H
) are excluded from the linearity error measurement.
3
Includes internal voltage reference error.
4
These parameters are guaranteed by design and not subject to production testing.
5
All input control signals are specified with t
= t
= 2 ns (10% to 90% of +5 V) and timed from a voltage level of 1.6 V.
6
The settling time specification does not apply for negative going transitions within the last 6 LSBs of ground. Some devices exhibit double the typical settling time in
this 6 LSB region.
Specifications subject to change without notice.
–3–
REV. 0
AD8300
(@ V
DD
= +5 V
±
10%, –40
°
C
≤
T
A
≤
+85
°
C, unless otherwise noted)
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PDF描述 |
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參數描述 |
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