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參數資料
| 型號： | AD8522 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | +5 Volt, Serial Input,Dual 12-Bit DAC(串行輸入,雙12位D/A轉換器) |
| 中文描述： | 5伏，串行輸入，雙12位DAC（串行輸入，雙12位的D / A轉換器） |
| 文件頁數： | 3/8頁 |
| 文件大小： | 189K |
| 代理商： | AD8522 |
AD8522
REV. A
–3–
SE RIAL INPUT RE GIST E R DAT A FORMAT
Last
D0
First
D15
D1
D2
D3
D4
D5
D6
D7
D8
D9
D10
D11
D12
D13
D14
DB0
DB1
DB2
DB3
DB4
DB5
DB6
DB7
DB8
DB9
DB10
DB11
NC
A
B
Sf/Hd
T able I. T ruth T able
Data Word
Sf/
Hd
E xt Pins
LDA
B
A
LDB
DAC Register
Hardware Load:
L
L
L
L
X
X
X
X
X
X
X
X
↓
↓
H
H
↓
H
↓
H
Loads DACA + DACB with Data from SR
Loads DACA with Data from SR
Loads DACB with Data from SR
No Load
Software Decode Load:
H
H
H
H
H
H
H
L
H
H
L
L
H
H
L
L
L
H
H
H
H
X
↓
H
↓
H
↓
H
X
↓
H
↓
H
↓
H
No Load
Loads DACB with Data from SR, See Note 1 Below
No Load
Loads DACA with Data from SR, See Note 1 Below
No Load
Loads DACA + DACB with Data from SR, See 1 Note Below
No Load
NOT ES
1
In software mode
LDA
and
LDB
perform the same function. T hey can be tied together or the unused pin should be tied high.
2
External Pins
LDA
and
LDB
should always be high when shifting Data into the shift register.
3
↓
symbol denotes negative transition.
200μA
1.6 VOLT
SDO
1.6mA
Figure 3. AC Timing SDO Pin Load Circuit
A
B
LD
CS
CLK
SDI
t
CSS
t
LD1
t
LD2
t
CSH
t
CL
t
DS
t
DH
SDI
CLK
LD
RS
t
LDW
t
CLRW
FS
ZS
t
S
±
1 LSB
ERROR BAND
t
S
t
LD2
DB11
DB10
Sf/
Hd
DB4
DB3
DB2
DB1
DB0
NC
V
OUT
t
LDW
t
CH
SDO
t
PD
Figure 2. Timing Diagram
相關PDF資料 |
PDF描述 |
|---|---|
| AD8531AKS | Precision, Quad, SPST Analog Switches |
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| AD8531 | Low Cost, 250 mA Output Single-Supply Amplifiers(低成本,250mA輸出,單電源放大器) |
| AD8532 | Low Cost, 250 mA Output Single-Supply Amplifiers(低成本,250mA輸出,單電源雙放大器) |
相關代理商/技術參數 |
參數描述 |
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