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參數(shù)資料
| 型號(hào)： | AD9433BSQ-105 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | ADC |
| 英文描述： | 12-Bit, 105 MSPS/125 MSPS IF Sampling A/D Converter |
| 中文描述： | 1-CH 12-BIT PROPRIETARY METHOD ADC, PARALLEL ACCESS, PQFP52 |
| 封裝： | POWER, PLASTIC, LQFP-52 |
| 文件頁(yè)數(shù)： | 10/24頁(yè) |
| 文件大小： | 1001K |
| 代理商： | AD9433BSQ-105 |
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REV. 0
AD9433
–10–
DUTY CYCLE HIGH
–
%
–
60
0
20
–
–
65
–
70
–
75
–
80
–
85
–
90
–
95
2ND HARMONIC (dBc)
3RD HARMONIC (dBc)
WORST OTHER (dBc)
SNR (dB)
30
40
50
60
70
80
90
10
TPC 13. Dynamic Performance vs. Encode Duty Cycle
f
S
= 105 MSPS, f
IN
= 49.3 MHz, Differential AIN @ –0.5 dBFS,
SFDR Enabled
–
0.75
0
512
1024
1536
2048
2560
3072
3584
4095
0
0.25
–
0.50
–
0.25
0.50
0.75
OUTPUT CODE
I
–
TPC 14. Integral Nonlinearity vs. Output Code
with SFDR Disabled
–
0.5
0
512
1024
1536
2048
2560
3072
3584
4095
–
0.4
–
0.3
–
0.2
–
0.1
0
0.1
0.2
0.3
0.4
0.5
OUTPUT CODE
D
–
TPC 15. Differential Nonlinearity vs. Output Code
ENCODE FREQUENCY
–
MHz
180
I
C
–
0
I
CC
(mA)
25
50
75
100
125
200
220
240
260
280
300
I
DD
(mA)
0
I
D
–
3
6
9
12
15
18
TPC 16. I
DD
and I
CC
vs. Encode Rate. f
IN
= 10.3 MHz,
Differential AIN @ –0.5 dBFS
–
0.75
0
512
1024
1536
2048
2560
3072
3584
4095
0
0.25
–
0.50
–
0.25
0.50
0.75
OUTPUT CODE
I
–
TPC 17. Integral Nonlinearity vs. Output Code with
SFDR Enabled
FREQUENCY
–
MHz
–
120
0
d
7.68
15.36
23.04
30.72
–
110
–
100
–
90
–
80
–
70
–
60
–
50
–
40
–
30
–
20
–
10
0
TPC 18. FFT: f
S
= 61.44 MSPS, f
IN
= 46.08 MHz, 4 WCDMA
Carriers, Differential AIN, SFDR Enabled
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