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參數(shù)資料
| 型號(hào)： | AD9944KCPRL |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 消費(fèi)家電 |
| 英文描述： | Complete 10-Bit and 12-Bit, 25 MHz CCD Signal Processors |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, QCC32 |
| 封裝： | 5 X 5 MM, MO-220-VHHD-2, LFCSP-32 |
| 文件頁數(shù)： | 6/20頁 |
| 文件大小： | 485K |
| 代理商： | AD9944KCPRL |
AD9943/AD9944
TIMING SPECIFICATIONS
C
L
= 20 pF, f
SAMP
= 25 MHz. See CCD-mode timing in Figure 14 and Figure 15, and serial timing in Figure 10 and Figure 11.
Table 5.
Parameter
SAMPLE CLOCKS
DATACLK, SHP, SHD Clock Period
DATACLK High/Low Pulse Width
SHP Pulse Width
SHD Pulse Width
CLPOB Pulse Width
1
SHP Rising Edge to SHD Falling Edge
SHP Rising Edge to SHD Rising Edge
Internal Clock Delay
DATA OUTPUTS
Output Delay
Pipeline Delay
SERIAL INTERFACE
Maximum SCK Frequency
SL to SCK Setup Time
SCK to SL Hold Time
SDATA Valid to SCK Rising Edge Setup
SCK Falling Edge to SDATA Valid Hold
Rev. B | Page 6 of 20
Symbol
t
CONV
t
ADC
t
SHP
t
SHD
t
COB
t
S1
t
S2
t
ID
t
OD
f
SCLK
t
LS
t
LH
t
DS
t
DH
Min
40
16
2
16
10
10
10
10
10
Typ
20
10
10
20
10
20
3.0
9.5
9
Max
Unit
ns
ns
ns
ns
Pixels
ns
ns
ns
ns
Cycles
MHz
ns
ns
ns
ns
1
Minimum CLPOB pulse width is for functional operation only. Wider typical pulses are recommended to achieve low noise clamp performance.
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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