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參數資料
| 型號： | AD9949AKCPZRL |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 消費家電 |
| 英文描述： | Circular Connector; No. of Contacts:61; Series:MS27474; Body Material:Aluminum; Connecting Termination:Crimp; Connector Shell Size:24; Circular Contact Gender:Socket; Circular Shell Style:Jam Nut Receptacle; Insert Arrangement:24-61 RoHS Compliant: No |
| 中文描述： | SPECIALTY CONSUMER CIRCUIT, QCC40 |
| 封裝： | 6 X 6 MM, LEAD FREE, MO-220-VJJD-2, LFCSP-40 |
| 文件頁數： | 20/36頁 |
| 文件大小： | 707K |
| 代理商： | AD9949AKCPZRL |
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AD9949
Rev. B | Page 20 of 36
NOTES
1. DIGITAL OUTPUT DATA (DOUT) PHASE IS ADJUSTABLE WITH RESPECT TO THE PIXEL PERIOD.
2. WITHIN ONE CLOCK PERIOD, THE DATA TRANSITION CAN BE PROGRAMMED TO ANY OF THE 48 LOCATIONS.
P[0]
P[48] = P[0]
CLI
1 PIXEL PERIOD
P[12]
P[24]
P[36]
DOUT
t
OD
0
Figure 19. Digital Output Phase Adjustment
NOTES
1. DEFAULT TIMING VALUES ARE SHOWN: SHDLOC = 0, DOUT PHASE = 0.
2. HIGHER VALUES OF SHD AND/OR DOUTPHASE WILL SHIFT DOUT TRANSITION TO THE RIGHT, WITH RESPECT TO CLI LOCATION.
DOUT
CCDIN
CLI
SHD
(INTERNAL)
N
N + 1
N + 2
N + 12
N + 11
N + 10
N + 9
N + 8
N + 7
N + 6
N + 5
N + 4
N + 3
N + 13
N – 13
N – 3
N – 4
N – 5
N – 6
N – 7
N – 8
N – 9
N – 10
N – 11
N – 12
N – 2
N – 1
N + 1
N
SAMPLE PIXEL N
N – 1
0
t
CLIDLY
PIPELINE LATENCY = 11 CYCLES
Figure 20. Pipeline Delay for Digital Data Output
相關PDF資料 |
PDF描述 |
|---|---|
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| AD9951 | 400 MSPS 14-Bit, 1.8 V CMOS Direct Digital Synthesizer |
| AD9951PCB | 400 MSPS 14-Bit, 1.8 V CMOS Direct Digital Synthesizer |
| AD9951YSV | 400 MSPS 14-Bit, 1.8 V CMOS Direct Digital Synthesizer |
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相關代理商/技術參數 |
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