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參數(shù)資料
| 型號： | AD9995 |
| 廠商： | Analog Devices, Inc. |
| 英文描述： | 12-Bit CCD Signal Processor with Precision Timing ⑩ Generator |
| 中文描述： | 12位CCD信號處理器與精密計時⑩發(fā)生器 |
| 文件頁數(shù)： | 4/60頁 |
| 文件大小： | 1593K |
| 代理商： | AD9995 |
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–4–
AD9995
ANALOG SPECIFICATIONS
Parameter
CDS
*
Allowable CCD Reset Transient
Max Input Range before Saturation
Max CCD Black Pixel Amplitude
Min
Typ
Max
Unit
Notes
500
mV
V p-p
mV
1.0
±50
VARIABLE GAIN AMPLIFIER (VGA)
Gain Control Resolution
Gain Monotonicity
Gain Range
Min Gain (VGA Code 0)
Max Gain (VGA Code 1023)
1024
Guaranteed
Steps
6
42
dB
dB
BLACK LEVEL CLAMP
Clamp Level Resolution
Clamp Level
Min Clamp Level (Code 0)
Max Clamp Level (Code 255)
256
Steps
Measured at ADC output.
0
255
LSB
LSB
A/D CONVERTER
Resolution
Differential Nonlinearity (DNL)
No Missing Codes
Full-Scale Input Voltage
12
–1.0
Bits
LSB
±0.5
Guaranteed
2.0
+1.0
V
VOLTAGE REFERENCE
Reference Top Voltage (REFT)
Reference Bottom Voltage (REFB)
2.0
1.0
V
V
SYSTEM PERFORMANCE
Gain Accuracy
Low Gain (VGA Code 0)
Max Gain (VGA Code 1023)
Peak Nonlinearity, 500 mV Input Signal
Total Output Noise
Power Supply Rejection (PSR)
Includes entire signal chain.
5.0
40.5
5.5
41.5
0.2
0.8
50
6.0
42.5
dB
dB
%
LSB rms
dB
Gain = (0.0351
Code) + 6 dB
12 dB gain applied.
AC grounded input, 6 dB gain applied.
Measured with step change on supply.
*
Input signal characteristics defined as follows:
OPTIC50mV MAX
RE500mV TYP
1V MAX
INPUT SIGNAL RANGE
Specifications subject to change without notice.
(AVDD = 3.0 V, f
CLI
= 36 MHz, Typical
Timing
Specifications, T
MIN
to T
MAX
, unless otherwise noted.)
REV. 0
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相關代理商/技術參數(shù) |
參數(shù)描述 |
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