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參數(shù)資料
| 型號： | ADSP-21060LKB-160 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數(shù)字信號處理 |
| 英文描述： | RES, 2.2 K SM CHIP 5% 50V 1/16 WATT, 0603 |
| 中文描述： | 48-BIT, 40 MHz, OTHER DSP, PBGA225 |
| 封裝： | PLASTIC, MS-034AAJ-2, BGA-225 |
| 文件頁數(shù)： | 38/47頁 |
| 文件大小： | 366K |
| 代理商： | ADSP-21060LKB-160 |
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–38–
ADSP-21060/ADSP-21060L
REV. D
JTAG Test Access Port and Emulation
ADSP-21060
Min
ADSP-21060L
Min
Parameter
Max
Max
Units
Timing Requirements:
t
TCK
t
STAP
t
HTAP
t
SSYS
t
HSYS
t
TRSTW
TCK Period
TDI, TMS Setup before TCK High
TDI, TMS Hold after TCK High
System Inputs Setup before TCK Low
1
System Inputs Hold after TCK Low
1
TRST
Pulsewidth
t
CK
5
6
7
18
4t
CK
t
CK
5
6
7
18.5
4t
CK
ns
ns
ns
ns
ns
ns
Switching Characteristics:
t
DTDO
t
DSYS
TDO Delay from TCK Low
System Outputs Delay after TCK Low
2
13
18.5
13
18.5
ns
ns
NOTES
1
System Inputs = DATA
, ADDR
,
RD
,
WR
, ACK,
SBTS
,
SW
,
HBR
,
HBG
,
CS
,
DMAR1
,
DMAR2
,
BR
, ID
, RPBA,
IRQ
, FLAG
3-0
, DR0, DR1,
TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1, LxDAT
, LxCLK, LxACK, EBOOT, LBOOT,
BMS
, CLKIN,
RESET.
2
System Outputs = DATA
, ADDR
,
MS
,
RD
,
WR
, ACK, PAGE, ADRCLK,
SW
,
HBG
, REDY,
DMAG1
,
DMAG2
,
BR
6-1
,
CPA
, FLAG
3-0
, TIMEXP, DT0,
DT1, TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1, LxDAT
3-0
, LxCLK, LxACK,
BMS.
TCK
t
STAP
t
TCK
t
HTAP
t
DTDO
t
SSYS
t
HSYS
t
DSYS
TMS
TDI
TDO
SYSTEM
INPUTS
SYSTEM
OUTPUTS
Figure 24. IEEE 11499.1 JTAG Test Access Port
相關(guān)PDF資料 |
PDF描述 |
|---|---|
| ADSP-21060LKS-133 | ADSP-2106x SHARC DSP Microcomputer Family |
| ADSP-21060LKS-160 | ADSP-2106x SHARC DSP Microcomputer Family |
| ADSP-21061KS-133 | ADSP-2106x SHARC DSP Microcomputer Family |
| ADSP-21061 | ADSP-2106x SHARC DSP Microcomputer Family |
| ADSP-21061L | ADSP-2106x SHARC DSP Microcomputer Family |
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參數(shù)描述 |
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