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參數資料
| 型號： | ADSP-2164BS-40 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數字信號處理 |
| 英文描述： | SWITCH SLIDE DP3T RT ANG L=6MM |
| 中文描述： | 24-BIT, 10.24 MHz, OTHER DSP, PQFP80 |
| 封裝： | METRIC, PLASTIC, QFP-80 |
| 文件頁數： | 29/39頁 |
| 文件大小： | 243K |
| 代理商： | ADSP-2164BS-40 |
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REV. 0
ADSP-216x
–29–
TIMING PARAMETERS (ADSP-2162/ADSP-2164/ADSP-2166)
CLOCK SIGNALS AND RESET
Frequency
Dependency
Min
10.24 MHz
Min
13.0 MHz
Min
16.67 MHz
Min
Parameter
Max
Max
Max
Max
Unit
Timing Requirements:
t
CK
CLKIN Period
t
CKL
CLKIN Width Low
t
CKH
CLKIN Width High
t
RSP
RESET
Width Low
Switching Characteristics:
t
CPL
CLKOUT Width Low
t
CPH
CLKOUT Width High
t
CKOH
CLKIN High to CLKOUT High
97.6
20
20
488
150
76.9
20
20
384.5
150
60.0
20
20
300
150
t
CK
20
20
5t
CK1
150
ns
ns
ns
ns
38.8
38.8
0
28.5
28.5
0
20
20
0
0.5t
CK
– 10
0.5t
CK
– 10
0
ns
ns
ns
20
20
20
20
NOTE
1
Applies after power-up sequence is complete. Internal phase lock loop requires no more than 2000 CLKIN cycles assuming stable CLKIN (not including crystal
oscillator startup time).
CLKOUT
CLKIN
t
CPL
t
CHOK
t
CPH
t
CKL
t
CKH
t
CK
Figure 27. Clock Signals
相關PDF資料 |
PDF描述 |
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相關代理商/技術參數 |
參數描述 |
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