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參數(shù)資料
| 型號(hào)： | ADSP-2196MBCA-140X |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 數(shù)字信號(hào)處理 |
| 英文描述： | DSP Microcomputer |
| 中文描述： | 16-BIT, 160 MHz, OTHER DSP, PBGA144 |
| 封裝： | MINI, BGA-144 |
| 文件頁數(shù)： | 51/68頁 |
| 文件大?。?/td> | 897K |
| 代理商： | ADSP-2196MBCA-140X |
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This information applies to a product under development. Its characteristics and specifications are subject to change with-
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51
REV. PrA
For current information contact Analog Devices at 800/262-5643
ADSP-2196
September 2001
JTAG Test And Emulation Port Timing
Table 22
and
Figure 26
describe JTAG port operations.
Table 22. JTAG Port Timing
Parameter
Description
Min
Max
Unit
Switching Characteristics
t
DTDO
TDO Delay from TCK Low
4
ns
t
DSYS
System Outputs Delay After TCK Low
1
0
5
ns
Timing Parameters
t
TCK
TCK Period
20
ns
t
STAP
TDI, TMS Setup Before TCK High
4
ns
t
HTAP
TDI, TMS Hold After TCK High
4
ns
t
SSYS
System Inputs Setup Before TCK Low
2
4
ns
t
HSYS
System Inputs Hold After TCK Low
2
5
ns
t
TRSTW
TRST Pulsewidth
3
4
ns
1
System Outputs = DATA15–0, ADDR21–0, MS3–0, RD, WR, ACK, CLKOUT, BG, PF7–0, TIMEXP, DT0, DT1, TCLK0, TCLK1, RCLK0, RCLK1,
TFS0, TFS1, RFS0, RFS1, BMS.
2
System Inputs = DATA15–0, ADDR21–0, RD, WR, ACK, BR, BG, PF7–0, DR0, DR1, TCLK0, TCLK1, RCLK0, RCLK1, TFS0, TFS1, RFS0, RFS1,
CLKIN, RESET.
3
50 MHz max.
Figure 26. JTAG Port Timing
&
3
&
3
3
3
3
3
3
相關(guān)PDF資料 |
PDF描述 |
|---|---|
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參數(shù)描述 |
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| ADSP-21990BBC | 制造商:Analog Devices 功能描述:DSP Fixed-Point 16-Bit 150MHz 150MIPS 196-Pin Mini-BGA 制造商:Rochester Electronics LLC 功能描述:160 MIPS, MIXED SIGNAL DSPWITH 14-BIT - Bulk |
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