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參數(shù)資料
| 型號(hào)： | ADUC848BS62-3 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | 10-825944-010 |
| 中文描述： | 8-BIT, FLASH, 12.58 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | 14 X 14 MM, PLASTIC, MO-112-AC-1, MQFP-52 |
| 文件頁(yè)數(shù)： | 96/108頁(yè) |
| 文件大小： | 1109K |
| 代理商： | ADUC848BS62-3 |
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ADuC845/ADuC847/ADuC848
Table 65.
EXTERNAL DATA MEMORY READ CYCLE Parameter
t
RLRH
RD Pulse Width
t
AVLL
Address Valid after ALE Low
t
LLAX
Address Hold after ALE Low
t
RLDV
RD Low to Valid Data In
t
RHDX
Data and Address Hold after RD
t
RHDZ
Data Float after RD
t
LLDV
ALE Low to Valid Data In
t
AVDV
Address to Valid Data In
t
LLWL
ALE Low to RD or WR Low
t
AVWL
Address Valid to RD or WR Low
t
RLAZ
RD Low to Address Float
t
WHLH
RD or WR High to ALE High
Rev. A | Page 96 of 108
12.58 MHz Core Clock
6.29 MHz Core Clock
Unit
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
ns
Min
60
60
145
0
130
190
60
Max
48
150
170
230
15
Min
125
120
290
0
255
375
120
Max
100
625
350
470
35
0
ALE (O)
PORT 0 (I/O)
PORT 2 (O)
t
WHLH
t
LLDV
t
LLWL
t
RLRH
t
AVWL
t
LLAX
t
AVLL
t
RLAZ
t
RHDX
t
RHDZ
t
AVDV
A0
A7 (OUT)
DATA (IN)
A16
A23
A8 A15
t
RLDV
PSEN (O)
RD (O)
Figure 72. External Data Memory Read Cycle
相關(guān)PDF資料 |
PDF描述 |
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參數(shù)描述 |
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