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參數資料
| 型號： | ADUC848BS8-5 |
| 廠商： | ANALOG DEVICES INC |
| 元件分類： | 微控制器/微處理器 |
| 英文描述： | MicroConverter Multichannel 24-/16-Bit ADCs with Embedded 62 kB Flash and Single-Cycle MCU |
| 中文描述： | 8-BIT, FLASH, 12.58 MHz, MICROCONTROLLER, PQFP52 |
| 封裝： | 14 X 14 MM, PLASTIC, MO-112-AC-1, MQFP-52 |
| 文件頁數： | 85/108頁 |
| 文件大小： | 1109K |
| 代理商： | ADUC848BS8-5 |
第1頁第2頁第3頁第4頁第5頁第6頁第7頁第8頁第9頁第10頁第11頁第12頁第13頁第14頁第15頁第16頁第17頁第18頁第19頁第20頁第21頁第22頁第23頁第24頁第25頁第26頁第27頁第28頁第29頁第30頁第31頁第32頁第33頁第34頁第35頁第36頁第37頁第38頁第39頁第40頁第41頁第42頁第43頁第44頁第45頁第46頁第47頁第48頁第49頁第50頁第51頁第52頁第53頁第54頁第55頁第56頁第57頁第58頁第59頁第60頁第61頁第62頁第63頁第64頁第65頁第66頁第67頁第68頁第69頁第70頁第71頁第72頁第73頁第74頁第75頁第76頁第77頁第78頁第79頁第80頁第81頁第82頁第83頁第84頁當前第85頁第86頁第87頁第88頁第89頁第90頁第91頁第92頁第93頁第94頁第95頁第96頁第97頁第98頁第99頁第100頁第101頁第102頁第103頁第104頁第105頁第106頁第107頁第108頁
ADuC845/ADuC847/ADuC848
INTERRUPT SYSTEM
The ADuC845/ADuC847/ADuC848 provide nine interrupt sources with two priority levels. The control and configuration of the
interrupt system is carried out through three interrupt-related SFRs:
Rev. A | Page 85 of 108
IE
IP
IEIP2
Interrupt Enable Register
Interrupt Priority Register
Secondary Interrupt Enable Register
IE—Interrupt Enable Register
SFR Address:
Power-On Default:
Bit Addressable:
A8H
00H
Yes
Table 58. IE SFR Bit Designations
Bit No.
Name
7
EA
Description
Set by the user to enable all interrupt sources.
Cleared by the user to disable all interrupt sources.
Set by the user to enable the ADC interrupt.
Cleared by the user to disable the ADC interrupt.
Set by the user to enable the Timer 2 interrupt.
Cleared by the user to disable the Timer 2 interrupt.
Set by the user to enable the UART serial port interrupt.
Cleared by the user to disable the UART serial port interrupt.
Set by the user to enable the Timer 1 interrupt.
Cleared by the user to disable the Timer 1 interrupt.
Set by the user to enable External Interrupt 1 (INT0).
Cleared by the user to disable External Interrupt 1 (INT0).
Set by the user to enable the Timer 0 interrupt.
Cleared by the user to disable the Timer 0 interrupt.
Set by the user to enable External Interrupt 0 (INT0).
Cleared by the user to disable External Interrupt 0 (INT0).
6
EADC
5
ET2
4
ES
3
ET1
2
EX1
1
ET0
0
EX0
IP—Interrupt Priority Register
SFR Address:
Power-On Default:
Bit Addressable:
B8H
00H
Yes
Table 59. IP SFR Bit Designations
Bit No.
7
6
5
4
3
2
1
0
Name
-----
PADC
PT2
PS
PT1
PX1
PT0
PX0
Description
Not Implemented. Write Don’t Care.
ADC Interrupt Priority (1 = High; 0 = Low).
Timer 2 Interrupt Priority (1 = High; 0 = Low).
UART Serial Port Interrupt Priority (1 = High; 0 = Low).
Timer 1 Interrupt Priority (1 = High; 0 = Low).
INT0 (External Interrupt 1) priority (1 = High; 0 = Low).
Timer 0 Interrupt Priority (1 = High; 0 = Low).
INT0 (External Interrupt 0) Priority (1 = High; 0 = Low).
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PDF描述 |
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