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參數資料
| 型號： | ATA8743-PXQW |
| 廠商： | Atmel |
| 文件頁數： | 90/238頁 |
| 文件大小： | 3971K |
| 描述： | MCU W/TRANSMITTER ASK/FSK 24QFN |
| 產品培訓模塊： | MCU Product Line Introduction |
| 標準包裝： | 6,000 |
| 頻率： | 868MHz ~ 928MHz |
| 應用： | 家庭自動化，遙感，RKE |
| 調制或協議： | ASK，FSK |
| 數據傳輸率 - 最大： | 32 kBit/s |
| 功率 - 輸出： | 3.5dBm ~ 8dBm |
| 電流 - 傳輸： | 9.3mA |
| 數據接口： | PCB，表面貼裝 |
| 天線連接器： | PCB，表面貼裝 |
| 存儲容量： | 4kB 閃存，256B EEPROM，256B SRAM |
| 電源電壓： | 1.8 V ~ 3.6 V |
| 工作溫度： | -40°C ~ 85°C |
| 封裝/外殼： | 24-VQFN 裸露焊盤 |
| 包裝： | 帶卷 (TR) |
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90
9152BINDCO02/10
ATA8743
uses to increment (or decrement) its value. The Timer/Counter is inactive when no clock source
is selected. The output from the Clock Select logic is referred to as the timer clock (clk
T0
).
The double buffered Output Compare Registers (OCR0A and OCR0B) is compared with the
Timer/Counter value at all times. The result of the compare can be used by the Waveform Gen-
erator to generate a PWM or variable frequency output on the Output Compare pins (OC0A and
OC0B). See Output Compare Unit on page 91 for details. The Compare Match event will also
set the Compare Flag (OCF0A or OCF0B) which can be used to generate an Output Compare
interrupt request.
20.2.2
Definitions
Many register and bit references in this section are written in general form. A lower case n
replaces the Timer/Counter number, in this case 0. A lower case x replaces the Output Com-
pare Unit, in this case Compare Unit A or Compare Unit B. However, when using the register or
bit defines in a program, the precise form must be used, i.e., TCNT0 for accessing
Timer/Counter0 counter value and so on.
The definitions in Table 20-1 on page 90 are also used extensively throughout the document.
Table 20-1. Definitions
20.3 Timer/Counter Clock Sources
The Timer/Counter can be clocked by an internal or an external clock source. The clock source
is selected by the Clock Select logic which is controlled by the Clock Select (CS02:0) bits
located in the Timer/Counter Control Register (TCCR0B). For details on clock sources and pres-
caler, see Timer/Counter Prescaler on page 136.
20.4 Counter Unit
The main part of the 8-bit Timer/Counter is the programmable bi-directional counter unit. Figure
20-2 on page 90 shows a block diagram of the counter and its surroundings.
Figure 20-2. Counter Unit Block Diagram
BOTTOM The counter reaches the BOTTOM when it becomes 0x00.
MAX
The counter reaches its MAXimum when it becomes 0xFF (decimal 255).
TOP
The counter reaches the TOP when it becomes equal to the highest value in the
count sequence. The TOP value can be assigned to be the fixed value 0xFF
(MAX) or the value stored in the OCR0A Register. The assignment is depen-
dent on the mode of operation.
DATA BUS
TCNTn
Control Logic
count
TOVn
(Int.Req.)
Clock Select
top
Tn
Edge
Detector
( From Prescaler )
clk
Tn
bottom
direction
clear
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