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參數資料
| 型號： | ICS271PGILF |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數： | 1/11頁 |
| 文件大?。?/td> | 0K |
| 描述： | VCXO CLK TRPL PLL PROGR 20-TSSOP |
| 標準包裝： | 74 |
| 系列： | VersaClock™ |
| 類型： | 時鐘/頻率合成器，扇出緩沖器（分配） |
| PLL： | 帶旁路 |
| 輸入： | 晶體 |
| 輸出： | CMOS |
| 電路數： | 1 |
| 比率 - 輸入:輸出： | 1:6 |
| 差分 - 輸入:輸出： | 無/無 |
| 頻率 - 最大： | 200MHz |
| 除法器/乘法器： | 是/是 |
| 電源電壓： | 3.135 V ~ 3.465 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 20-TSSOP（0.173"，4.40mm 寬） |
| 供應商設備封裝： | 20-TSSOP |
| 包裝： | 管件 |
| 其它名稱： | 271PGILF |
DATASHEET
TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER
ICS271
IDT / ICS TRIPLE PLL FIELD PROGRAMMABLE VCXO CLOCK SYNTHESIZER 1
ICS271
REV E 051310
Description
The ICS271 field programmable VCXO clock synthesizer
generates up to six high-quality, high-frequency clock
outputs including multiple reference clocks from a
low-frequency crystal input. It is designed to replace
crystals and crystal oscillators in most electronic systems.
Using IDT’s VersaClockTM software to configure PLLs and
outputs, the ICS271 contains a One-Time Programmable
(OTP) ROM for field programmability. Programming
features include VCXO, eight selectable configuration
registers and up to two sets of three low-skew outputs.
Each of the two output groups are powered by a separate
VDDO voltage. VDDO may vary from 1.8 V to VDD.
Using Phase-Locked Loop (PLL) techniques, the device
runs from a standard fundamental mode, inexpensive
crystal, or clock. It can replace VCXOs, multiple crystals
and oscillators, saving board space and cost.
The ICS271 is also available in factory programmed custom
versions for high-volume applications.
Features
Packaged as 20-pin TSSOP – Pb-free, RoHS compliant
Eight addressable registers
Replaces multiple crystals and oscillators
Output frequencies up to 200 MHz at 3.3 V
Input crystal frequency of 5 to 27 MHz
Up to six reference outputs
Separate 1.8 to 3.3 V VDDO output level controls for
each bank of 3 outputs
Up to two sets of three low-skew outputs
Operating voltages of 3.3 V
Controllable output drive levels
Advanced, low-power CMOS process
Block Diagram
Voltage
Controlled
Crystal
Oscillator
GND
2
3
VDD
PDTS
PLL2
PLL3
Divide
Logic
and
Output
Enable
Control
S2:S0
CLK1
CLK6
CLK5
CLK4
CLK3
CLK2
3
OTP
ROM
with
PLL
Values
X2
Crystal
External capacitors
are required.
X1
PLL1
VIN
VDDO1
VDDO2
相關PDF資料 |
PDF描述 |
|---|---|
| ICS275PGILF | VCXO CLK SYNTH TRPL PLL 16-TSSOP |
| ICS276PGILF | VCXO CLK SYNTH TRPL PLL 16-TSSOP |
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| ICS290PGLF | IC CLK SYNTH TRPL PLL 20-TSSOP |
| ICS291PGILF | IC CLK SYNTH TRPL PLL 20-TSSOP |
相關代理商/技術參數 |
參數描述 |
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