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參數資料
| 型號： | ICS670M-01T |
| 英文描述： | Low Phase Noise Zero Delay Buffer and Multiplier |
| 中文描述： | 低相位噪聲零延遲緩沖器和乘法器 |
| 文件頁數： | 1/5頁 |
| 文件大小： | 84K |
| 代理商： | ICS670M-01T |
ICS670-01
Low Phase Noise Zero Delay Buffer and Multiplier
MDS 670-01 B
Integrated Circuit Systems 525 Race Street San Jose CA95126(408) 295-9800telhttp://www.icst.com
1
Revision 100900
Printed 11/15/00
Block Diagram
Description
Features
Packaged in 16 pin SOIC
Clock inputs from 5 to 160 MHz (see page 2)
Patented PLL with the lowest phase noise
Output clocks up to 160 MHz at 3.3 V
15 selectable on-chip multipliers
Power down mode available
Low phase noise: -124 dBc/Hz at 10 kHz
Output Enable function tri-states outputs
Low jitter 15 ps one sigma
Full swing CMOS outputs with 25 mA drive
capability at TTL levels
Advanced, low power, sub-micron CMOS process
Industrial temperature version available
3.3 V or 5 V operation
Phase
Detector,
Charge
Pump, and
Loop Filter
Voltage
Controlled
Oscillator
FBCLK
Output
Buffer
ICLK
CLK2
Output
Buffer
FBIN
External feedback from FBCLK is recommended.
OE1
OE2
The ICS670-01 is a high speed, low phase noise
Zero Delay Buffer (ZDB) which integrates ICS’
proprietary analog/digital Phase Locked Loop
(PLL) techniques. Part of ICS’ ClockBlocks
family, the zero delay feature means that the rising
edge of the input clock aligns with the rising edges
of the outputs, giving the appearance of no delay
through the device. There are two identical outputs
on the chip. The FBCLK should be used to
connect to the FBIN. Each output has its own
output enable pin.
The chip is ideal for synchronizing outputs in a
large variety of systems, from personal computers
to data communications to video. By allowing off-
chip feedback paths, the ICS670-01 can eliminate
the delay through other devices. The 15 different
on-chip multipliers work in a variety of
applications. For other multipliers, including
fractional multipliers, see the ICS527.
ROM-
Based
Multipliers
4
S3:S0
相關PDF資料 |
PDF描述 |
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