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參數資料
| 型號： | ICS843001AI22 |
| 英文描述： | FEMTOCLOCKS⑩ CRYSTAL/LVCMOS-TO-3.3V, 2.5V LVPECL FREQUENCY SYNTHESIZER |
| 中文描述： | FEMTOCLOCKS⑩CRYSTAL/LVCMOS-TO-3.3V，2.5V的LVPECL的頻率合成器 |
| 文件頁數： | 1/17頁 |
| 文件大小： | 211K |
| 代理商： | ICS843001AI22 |
843001AGI-22
www.icst.com/products/hiperclocks.html
REV. A AUGUST 1, 2005
1
Integrated
Circuit
Systems, Inc.
ICS843001I-22
F
EMTO
C
LOCKS
C
RYSTAL
/LVCMOS-
TO
-
3.3V, 2.5V LVPECL F
REQUENCY
S
YNTHESIZER
G
ENERAL
D
ESCRIPTION
The ICS843001I-22 is a a highly versatile, low
phase noise LVPECL/LVCMOS Synthesizer
which can generate low jitter reference clocks for
a variety of communications applications and is
a member of the HiPerClocks
TM
family of high
performance clock solutions from ICS. The dual
crystal interface allows the synthesizer to support up to two
communications standards in a given application (i.e. 1GB
Ethernet with a 25MHz crystal and 1Gb Fibre Channel
using a 25.5625MHz crystal). The rms phase jitter
performance is typically less than 1ps, thus making the
device acceptable for use in demanding applications such
as OC48 SONET and 10Gb Ethernet. The ICS843001I-22
is packaged in a small 24-pin TSSOP package.
F
EATURES
One 3.3V or 2.5V LVPECL output pair and
one LVCMOS/LVTTL output
Selectable crystal oscillator interface
or LVCMOS/LVTTL single-ended input
VCO range: 490MHz - 640MHz
Output frequency range: 490MHz - 640MHz
Supports the following applications:
SONET, Ethernet, Fibre Channel, Serial ATA, and HDTV
RMS phase jitter @ 125MHz (1.875MHz - 20MHz):
0.5ps (typical)
Full 3.3V or 2.5V supply modes
-40°C to 85°C ambient operating temperature
Available in both, Standard and RoHS/Lead-Free
compliant packages
HiPerClockS
ICS
P
IN
A
SSIGNMENT
V
CCO
_
LVCMOS
N0
N1
N2
V
CCO
_
LVPECL
Q
nQ
V
EE
V
CCA
V
CC
XTAL_OUT1
XTAL_IN1
12
11
10
01
00
00
01
10
11
Phase
Detector
VCO
490MHz -640MHz
000 ÷18
001 ÷22
010 ÷24
011 ÷25
100 ÷32
(default)
101 ÷40
N
000 ÷1
001 ÷2
010 ÷3
011 ÷4
(default)
100 ÷5
101 ÷6
110 ÷8
111 ÷10
M
3
3
OSC
OSC
ICS843001I-22
24-Lead TSSOP
4.40mm x 7.8mm x 0.92mm
package body
G Package
Top View
Q
1
2
3
4
5
6
7
8
9
10
11
REF_OUT
V
EE
OE
M2
M1
M0
MR
SEL1
SEL0
CLK
XTAL_IN0
XTAL_OUT0
24
23
22
21
20
19
18
17
16
15
14
13
B
LOCK
D
IAGRAM
N2:N0
SEL0
SEL1
XTAL_IN0
XTAL_OUT0
XTAL_IN1
XTAL_OUT1
CLK
MR
M2:M0
OE
nQ
Pulldown
Pulldown
Pulldown
Pulldown
REF_OUT
C
ONTROL
I
NPUT
F
UNCTION
T
ABLE
Pullup/Pulldown
t
u
p
n
r
n
O
0
1
O
L
F
o
C
s
u
p
t
u
O
E
Q
n
-
g
H
g
H
v
A
Q
T
U
Z
e
Z
O
_
-
v
A
g
H
F
g
E
H
R
Z
Z
e
-
T
A
-
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PDF描述 |
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