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參數(shù)資料
| 型號(hào)： | ICS85102AGILFT |
| 廠商： | IDT, Integrated Device Technology Inc |
| 文件頁數(shù)： | 1/16頁 |
| 文件大小： | 0K |
| 描述： | IC CLOCK BUFFER MUX 2:2 16-TSSOP |
| 標(biāo)準(zhǔn)包裝： | 2,500 |
| 系列： | HiPerClockS™ |
| 類型： | 扇出緩沖器（分配），多路復(fù)用器 |
| 電路數(shù)： | 1 |
| 比率 - 輸入:輸出： | 2:2 |
| 差分 - 輸入:輸出： | 是/是 |
| 輸入： | HCSL，LVCMOS，LVDS，LVHSTL，LVPECL，LVTTL，SSTL |
| 輸出： | HCSL |
| 頻率 - 最大： | 500MHz |
| 電源電壓： | 2.97 V ~ 3.63 V |
| 工作溫度： | -40°C ~ 85°C |
| 安裝類型： | 表面貼裝 |
| 封裝/外殼： | 16-TSSOP（0.173"，4.40mm 寬） |
| 供應(yīng)商設(shè)備封裝： | 16-TSSOP |
| 包裝： | 帶卷 (TR) |
| 其它名稱： | 85102AGILFT |
LOW SKEW, 1-TO-2, DIFFERENTIAL/LVCMOS-
TO-0.7V HCSL FANOUT BUFFER
ICS85102I
IDT / ICS 0.7V HCSL FANOUT BUFFER
1
ICS85102AGI REV. A JUNE 10, 2008
GENERAL DESCRIPTION
The ICS85102I is a low skew, high performance 1-
to-2 Differential-to-HCSL fanout buffer and a mem-
ber of the HiPerClockS family of High Perfor-
mance Clock Solutions from IDT. The ICS85102I
has a differential clock input. The CLK0, nCLK0
input pair can accept most standard differential input levels.
The clock enable is internally synchronized to eliminate runt
clock pulses on the output during asynchronous assertion/
deassertion of the clock enable pin.
Guaranteed output and par t-to-par t skew characteristics
make the ICS85102I ideal for those applications demanding
well defined performance and repeatability.
FEATURES
Two 0.7V differential HCSL outputs
Selectable differential CLK0, nCLK0 or LVCMOS inputs
CLK0, nCLK0 pair can accept the following differential
input levels: LVPECL, LVDS, LVHSTL, HCSL, SSTL
CLK1 can accept the following input levels:
LVCMOS or LVTTL
Maximum output frequency: 500MHz
Translates any single-ended input signal to 3.3V
HCSL levels with resistor bias on nCLK input
Output skew: 65ps (maximum)
Part-to-part skew: 600ps (maximum)
Propagation delay: 3.2ns (maximum)
Additive phase jitter, RMS: 0.14ps typical @ 250MHz
3.3V operating supply
-40°C to 85°C ambient operating temperature
Available in both standard (RoHS 5) and lead-free (RoHS 6)
packages
BLOCK DIAGRAM
PIN ASSIGNMENT
HiPerClockS
ICS
ICS85102I
16-Lead TSSOP
4.4mm x 5.0mm x 0.925mm body package
G Package
Top View
Q0
nQ0
Q1
nQ1
CLK_EN
CLK_SEL
IREF
CLK1
CLK0
nCLK0
D
LE
Q
0
1
Pulldown
Pullup
Pullup/Pulldown
1
2
3
4
5
6
7
8
16
15
14
13
12
11
10
9
CLK_EN
CLK_SEL
CLK0
nCLK0
CLK1
nc
IREF
GND
VDD
Q0
nQ0
Q1
nQ1
VDD
相關(guān)PDF資料 |
PDF描述 |
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