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參數資料
| 型號： | ICS91857YLLFT-LF-T |
| 英文描述： | 68/MDR/RC/F SKT/BD MT/ST/M2.6/SCW/30MIN |
| 中文描述： | 價值SSTL_2時鐘驅動器（60MHz時- 220MHz） |
| 文件頁數： | 1/14頁 |
| 文件大小： | 144K |
| 代理商： | ICS91857YLLFT-LF-T |
Integrated
Circuit
Systems, Inc.
ICS91857
0494C—08/15/05
Block Diagram
Value SSTL_2 Clock Driver (60MHz - 220MHz)
Pin Configuration
48-Pin TSSOP
Recommended Application:
Zero delay board fan-out memory modules
Product Description/Features:
Meets PC3200 specification for DDRI-400 support
Low skew, low jitter PLL clock driver
1 to 10 differential clock distribution (SSTL_2)
Feedback pins for input to output synchronization
PD# for power management
Spread Spectrum tolerant inputs
Auto PD when input signal removed
Switching Characteristics:
CYCLE - CYCLE jitter (>100MHz):<75ps
OUTPUT - OUTPUT skew: <100ps
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X
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Z
Z
Z
f
Functionality
PLL
FB_INT
FB_INC
CLK_INC
CLK_INT
PD#
Control
Logic
FB_OUTT
FB_OUTC
CLKT0
CLKC0
CLKT1
CLKC1
CLKT2
CLKC2
CLKT3
CLKC3
CLKT4
CLKC4
CLKT5
CLKC5
CLKT6
CLKC6
CLKT7
CLKC7
CLKT8
CLKC8
CLKT9
CLKC9
6.10 mm. Body, 0.50 mm. pitch TSSOP
GND
CLKC0
CLKT0
VDD
CLKT1
CLKC1
GND
GND
CLKC2
CLKT2
VDD
VDD
CLK_INT
CLK_INC
VDD
AVDD
AGND
GND
CLKC3
CLKT3
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CLKT4
CLKC4
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GND
CLKC5
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CLKT6
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PD#
FB_INT
FB_INC
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FB_OUTC
FB_OUTT
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CLKC8
CLKT8
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9
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9
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PDF描述 |
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相關代理商/技術參數 |
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