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參數資料
型號: ICS950219YFLF-T
廠商: INTEGRATED DEVICE TECHNOLOGY INC
元件分類: 時鐘產生/分配
英文描述: 200.4 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO48
封裝: 0.300 INCH, MO-118, SSOP-48
文件頁數: 1/19頁
文件大小: 206K
代理商: ICS950219YFLF-T
Integrated
Circuit
Systems, Inc.
ICS950219
Preliminary Product Preview
0640D—12/30/03
Pin Configuration
Recommended Application:
CK-408 clock for Intel 845 chipset with P4 processor.
Output Features:
3 - Pairs of differential CPU clocks (differential current mode)
4 - 3V66 @ 3.3V
10 - PCI @ 3.3V
1 - 48MHz @ 3.3V
24-48 MHz selectable output @ 3.3V
2 - REF @ 3.3V, 14.318MHz
Features/Benefits:
Programmable output frequency.
Programmable output divider ratios.
Programmable output rise/fall time.
Programmable output skew.
Programmable spread percentage for EMI control.
Watchdog timer technology to reset system
if system malfunctions.
Programmable watch dog safe frequency.
Support I
2C Index read/write and block read/write operations.
Uses external 14.318MHz crystal.
Key Specifications:
CPU Output Jitter <150ps
3V66 Output Jitter <250ps
CPU Output Skew <100ps
Programmable Timing Control Hub for P4
* Internal Pull-up resistor of 120K to VDD
48-Pin 300-mil SSOP
Frequency Table
2
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3
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3
16
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6
63
3
.
3
*MULTISEL1/REF1
VDDREF
X1
X2
GND
*FS2/PCICLK0
*FS3/PCICLK1
PCICLK2
VDDPCI
*FS4/PCICLK3
PCICLK4
PCICLK5
GND
PCICLK6
PCICLK7
PCICLK8
PCICLK9
VDDPCI
Vtt_PWRGD#
RESET#
GND
*FS0/48MHz
*FS1/24_48MHz
AVDD48
REF0/MULTSEL0*
GND
VDDCPU
CPUCLKT2
CPUCLKC2
GND
PD#
CPUCLKT0
CPUCLKC0
VDDCPU
CPUCLKT1
CPUCLKC1
GND
I REF
AVDD
GND
VDD3V66
3V66_0
3V66_1
GND
3V66_2
3V66_3
SCLK
SDATA
ICS950219
1
2
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6
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9
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12
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PRODUCT PREVIEW documents contain information on new products in the sampling or preproduction phase of development. Characteristic data and other specifications are subject to change
without notice.
相關PDF資料
PDF描述
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ICS950227YFLFT 133.33 MHz, PROC SPECIFIC CLOCK GENERATOR, PDSO56
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